参数资料
| 型号： | ADF4112BRUZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 24/28页 |
| 文件大小： | 0K |
| 描述： | IC SYNTH PLL RF 3.0GHZ 16-TSSOP |
| 标准包装： | 96 |
| 类型： | 时钟/频率合成器，RF |
| PLL： | 是 |
| 输入： | CMOS，TTL |
| 输出： | 时钟 |
| 电路数： | 1 |
| 比率 - 输入:输出： | 2:1 |
| 差分 - 输入:输出： | 是/无 |
| 频率 - 最大： | 3GHz |
| 除法器/乘法器： | 是/无 |
| 电源电压： | 2.7 V ~ 5.5 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 16-TSSOP（0.173"，4.40mm 宽） |
| 供应商设备封装： | 16-TSSOP |
| 包装： | 管件 |
| 产品目录页面： | 551 (CN2011-ZH PDF) |
| 配用： | EVAL-ADF4112EBZ1-ND - BOARD EVAL FOR ADF4112 EVAL-ADF411XEBZ1-ND - BOARD EVAL FOR ADF411X NO CHIP |
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Data Sheet
ADF4110/ADF4111/ADF4112/ADF4113
Rev. F | Page 5 of 28
TIMING CHARACTERISTICS
Guaranteed by design but not production tested. AVDD = DVDD = 3 V ± 10%, 5 V ± 10%; AVDD ≤ VP ≤ 6 V;
AGND = DGND = CPGND = 0 V; RSET = 4.7 kΩ; TA = TMIN to TMAX, unless otherwise noted.
Table 2.
Parameter
Limit at TMIN to TMAX (B Version)
Unit
Test Conditions/Comments
t1
10
ns min
DATA to CLOCK setup time
t2
10
ns min
DATA to CLOCK hold time
t3
25
ns min
CLOCK high duration
t4
25
ns min
CLOCK low duration
t5
10
ns min
CLOCK to LE setup time
t6
20
ns min
LE pulse width
CLOCK
DATA
LE
DB23 (MSB)
DB22
DB2
DB1
(CONTROL BIT C2)
DB0 (LSB)
(CONTROL BIT C1)
t1
t2
t3
t4
t5
t6
03
49
6-
00
2
Figure 2. Timing Diagram
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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