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参数资料
| 型号： | ADG3308BCPZ-REEL7 |
| 厂商： | Analog Devices Inc |
| 文件页数： | 20/20页 |
| 文件大小： | 0K |
| 描述： | IC XLATOR 8CH 1.2-5.5V 20-LFCSP |
| 标准包装： | 1 |
| 逻辑功能： | 变换器，双向 |
| 位数： | 8 |
| 输入类型： | 逻辑 |
| 输出类型： | 逻辑 |
| 数据速率： | 50Mbps |
| 通道数： | 8 |
| 输出/通道数目： | 1 |
| 差分 - 输入:输出： | 无/无 |
| 传输延迟（最大）： | 6ns |
| 电源电压： | 1.15 V ~ 5.5 V |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 20-VFQFN 裸露焊盘，CSP |
| 供应商设备封装： | 20-LFCSP-VQ |
| 包装： | 标准包装 |
| 产品目录页面： | 802 (CN2011-ZH PDF) |
| 其它名称： | ADG3308BCPZ-REEL7DKR |
Data Sheet
ADG3308/ADG3308-1
Rev. D | Page 9 of 20
0
1
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6
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8
9
I CCY
(
mA)
13
23
33
43
53
63
73
CAPACITIVE LOAD (pF)
TA = 25°C
1 CHANNEL
VCCA = 1.8V
VCCY = 3.3V
30Mbps
20Mbps
10Mbps
5Mbps
50Mbps
04865-
016
Figure 11. ICCY vs. Capacitive Load at Pin Y
for A
→Y (1.8 V→3.3 V) Level Translation
0
0.5
1.0
1.5
2.0
2.5
3.0
3.5
4.0
4.5
5.0
I CCA
(
mA)
13
23
33
43
53
CAPACITIVE LOAD (pF)
50Mbps
TA = 25°C
1 CHANNEL
VCCA = 1.8V
VCCY = 3.3V
5Mbps
10Mbps
20Mbps
30Mbps
04865-
017
Figure 12. ICCA vs. Capacitive Load at Pin A
for Y
→A (3.3 V→1.8 V) Level Translation
0
2
4
6
8
10
12
I CCY
(
mA)
13
23
33
43
53
63
73
CAPACITIVE LOAD (pF)
TA = 25°C
1 CHANNEL
VCCA = 3.3V
VCCY = 5V
50Mbps
30Mbps
20Mbps
10Mbps
5Mbps
04865-
020
Figure 13. ICCY vs. Capacitive Load at Pin Y
for A
→Y (3.3 V→5 V) Level Translation
0
2
4
6
I CCA
(
mA)
13
23
33
43
53
CAPACITIVE LOAD (pF)
TA = 25°C
1 CHANNEL
VCCA = 3.3V
VCCY = 5V
50Mbps
20Mbps
10Mbps
5Mbps
1
3
5
7
04865-
021
30Mbps
Figure 14. ICCA vs. Capacitive Load at Pin A
for Y
→A (5 V→3.3 V) Level Translation
0
1
2
3
4
5
6
7
8
9
10
13
23
33
43
53
63
73
CAPACITIVE LOAD (pF)
R
ISE
T
IME
(n
s)
TA = 25°C
1 CHANNEL
DATA RATE = 50kbps
VCCA = 1.2V, VCCY = 1.8V
VCCA = 1.8V, VCCY = 3.3V
VCCA = 3.3V, VCCY = 5V
04865-
023
Figure 15. Rise Time vs. Capacitive Load at Pin Y (A
→Y Level Translation)
0
0.5
1.0
1.5
2.0
2.5
3.0
3.5
4.0
13
23
33
43
53
63
73
CAPACITIVE LOAD (pF)
FA
LL
TIM
E
(
ns
)
TA = 25°C
1 CHANNEL
DATA RATE = 50kbps
VCCA = 1.8V, VCCY = 3.3V
VCCA = 3.3V, VCCY = 5V
VCCA = 1.2V, VCCY = 1.8V
04865-
024
Figure 16. Fall Time vs. Capacitive Load at Pin Y (A
→Y Level Translation)
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