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参数资料
| 型号： | ADP2127ACNZ-1.20R7 |
| 厂商： | Analog Devices Inc |
| 文件页数： | 4/20页 |
| 文件大小： | 0K |
| 描述： | IC REG BUCK SYNC 1.2V 0.5A 6EWLP |
| 产品变化通告： | 8mm Carrier Tape Changes 28/Feb/2012 |
| 标准包装： | 3,000 |
| 类型： | 降压（降压） |
| 输出类型： | 固定 |
| 输出数： | 1 |
| 输出电压： | 1.2V |
| 输入电压： | 2.1 V ~ 5.5 V |
| PWM 型： | 电压模式 |
| 频率 - 开关： | 6MHz |
| 电流 - 输出： | 500mA |
| 同步整流器： | 是 |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 6-SMD，无引线 |
| 包装： | 带卷 (TR) |
| 供应商设备封装： | 6-WLP Embedded（1.3x0.90） |
ADP2126/ADP2127
Data Sheet
Parameter
Symbol
Test Conditions/Comments
Min
Typ
Max
Unit
TIMING
VIN High to EXTCLK On 2
t 1
V IN = 2.1 V to 5.5 V
200
μs
EXTCLK On to V OUT Rising
EXTCLK On to V OUT Rising
V OUT Power-Up Time (Soft Start) 2
EXTCLK Off to V OUT Falling
EXTCLK Off to V OUT Falling
V OUT Power-Down Time
t 2 (CLOCK)
t 2 (LOGIC)
t 3
t 5 (CLOCK)
t 5 (LOGIC)
t 6
D EXTCLK = 40% to 60%, f EXTCLK = 6 MHz
D EXTCLK = 40% to 60%, f EXTCLK = 27 MHz
EXTCLK = logic high
C OUT = 2.2 μF, R LOAD = 3.6 Ω
D EXTCLK = 40% to 60%, f EXTCLK = 6 MHz to 27 MHz
EXTCLK = logic high, no load
C OUT = 2.2 μF, R LOAD = 3.6 Ω
250
250
285
320
320
315
70
9
0
16
400
400
385
200
17
μs
μs
μs
μs
μs
μs
μs
C OUT = 2.2 μF, no load
465
μs
Minimum Shutdown Time 2
Minimum Power-Off Time 2
t 5 + t 6
t 7
C OUT = 2.2 μF, no load
1400
500
μs
μs
1
2
3
4
5
The total shutdown current is the addition of VIN shutdown current and SW leakage.
Guaranteed by design.
Transients not included in voltage accuracy specifications.
The PFM output voltage will be higher than the PWM output voltage. See the Typi cal Performance Characteristics section.
Thermal shutdown protection is only active in PWM mode.
TIMING DIAGRAMS
VIN
V IN × 90%
t 7
V IN × 10%
V OUT
t 2
t 3
t 5
t 6
V OUT(NOM) × 10%
EXTCLK
t 1
Figure 2. Clock Enable I/O Timing Diagram
VIN
V IN × 90%
t 7
V IN × 10%
V OUT
t 2
t 3
t 5
t 6
V OUT(NOM) × 10%
EXTCLK
t 1
Figure 3. Logic Enable I/O Timing Diagram (Logic High Enable Feature Available Only on Certain Models)
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PDF描述 |
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参数描述 |
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