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参数资料
| 型号： | ADSP-2104BPZ-80 |
| 厂商： | Analog Devices Inc |
| 文件页数： | 16/36页 |
| 文件大小： | 0K |
| 描述： | IC DSP CONTROLLER 16BIT 68PLCC |
| 产品变化通告： | Product Discontinuance 27/Oct/2011 |
| 标准包装： | 19 |
| 系列： | ADSP-21xx |
| 类型： | 定点 |
| 接口： | 同步串行端口（SSP） |
| 时钟速率： | 20MHz |
| 非易失内存： | 外部 |
| 芯片上RAM： | 1.5kB |
| 电压 - 输入/输出： | 5.00V |
| 电压 - 核心： | 5.00V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 68-LCC（J 形引线） |
| 供应商设备封装： | 68-PLCC（24.23x24.23） |
| 包装： | 管件 |
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ADSP-2104/ADSP-2109
REV. 0
–23–
Frequency
20 MHz
Dependency
Parameter
Min
Max
Min
Max
Unit
Timing Requirement:
tBH
BR Hold after CLKOUT High
1
17.5
0.25tCK + 5
ns
tBS
BR Setup before CLKOUT Low
1
32.5
0.25tCK + 20
ns
Switching Characteristic:
tSD
CLKOUT High to DMS,
32.5
0.25tCK + 20
ns
PMS, BMS, RD, WR Disable
tSDB
DMS, PMS, BMS, RD, WR
0
ns
Disable to BG Low
tSE
BG High to DMS, PMS,
0
ns
BMS, RD, WR Enable
tSEC
DMS, PMS, BMS, RD, WR
2.5
0.25tCK – 10
ns
Enable to CLKOUT High
NOTES
1If BR meets the t
BS and tBH setup/hold requirements, it will be recognized in the current processor cycle; otherwise it is recognized in the following cycle. BR requires
a pulse width greater than 10 ns.
Note: BG is asserted in the cycle after BR is recognized. No external synchronization circuit is needed when BR is generated as an asynchronous signal.
TIMING PARAMETERS (ADSP-2104/ADSP-2109)
BUS REQUEST/GRANT
CLKOUT
PMS, DMS
BMS, RD
WR
BR
BG
CLKOUT
tSD
tSDB
tSE
tSEC
tBH
tBS
Figure 21. Bus Request/Grant
相关PDF资料 |
PDF描述 |
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