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参数资料
| 型号： | ADSP-2104BPZ-80 |
| 厂商： | Analog Devices Inc |
| 文件页数： | 18/36页 |
| 文件大小： | 0K |
| 描述： | IC DSP CONTROLLER 16BIT 68PLCC |
| 产品变化通告： | Product Discontinuance 27/Oct/2011 |
| 标准包装： | 19 |
| 系列： | ADSP-21xx |
| 类型： | 定点 |
| 接口： | 同步串行端口（SSP） |
| 时钟速率： | 20MHz |
| 非易失内存： | 外部 |
| 芯片上RAM： | 1.5kB |
| 电压 - 输入/输出： | 5.00V |
| 电压 - 核心： | 5.00V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 68-LCC（J 形引线） |
| 供应商设备封装： | 68-PLCC（24.23x24.23） |
| 包装： | 管件 |
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ADSP-2104/ADSP-2109
REV. 0
–25–
Frequency Dependency
(CLKIN
≤ 20 MHz)
Parameter
Min
Max
Unit
Switching Characteristic:
tDW
Data Setup before WR High
0.5tCK – 13 + w
ns
tDH
Data Hold after WR High
0.25tCK – 10
ns
tWP
WR Pulse Width
0.5tCK – 8 + w
ns
tWDE WR Low to Data Enabled
0
tASW
A0–A13, DMS, PMS Setup before WR Low
0.25tCK – 10
ns
tDDR
Data Disable before WR or RD Low
0.25tCK – 10
ns
tCWR CLKOUT High to WR Low
0.25tCK – 5
0.25tCK + 10
ns
tAW
A0–A13, DMS, PMS, Setup before WR
Deasserted
0.75tCK – 22 + w
ns
tWRA A0–A13, DMS, PMS Hold after WR
Deasserted
0.25tCK – 9
ns
tWWR WR High to RD or WR Low
0.5tCK – 5
ns
TIMING PARAMETERS (ADSP-2104/ADSP-2109)
MEMORY WRITE
20 MHz
Parameter
Min
Max
Unit
Switching Characteristic:
tDW
Data Setup before WR High
12
ns
tDH
Data Hold after WR High
2.5
ns
tWP
WR Pulse Width
17
ns
tWDE
WR Low to Data Enabled
0
ns
tASW
A0–A13, DMS, PMS Setup before
2.5
ns
WR Low
tDDR
Data Disable before WR or RD Low
2.5
ns
tCWR
CLKOUT High to WR Low
7.5
22.5
ns
tAW
A0–A13, DMS, PMS, Setup before WR
15.5
ns
Deasserted
tWRA
A0–A13, DMS, PMS Hold after WR
3.5
ns
Deasserted
tWWR
WR High to RD or WR Low
20
ns
Figure 23. Memory Write
CLKOUT
A0 – A13
D
WR
DMS, PMS
RD
tWDE
tDDR
tDH
tWWR
tWRA
tWP
tDW
tAW
tCWR
tASW
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