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参数资料
| 型号： | ADSP-2105BP-80 |
| 厂商： | Analog Devices Inc |
| 文件页数： | 40/64页 |
| 文件大小： | 0K |
| 描述： | IC DSP CONTROLLER 16BIT 68PLCC |
| 标准包装： | 19 |
| 系列： | ADSP-21xx |
| 类型： | 定点 |
| 接口： | 同步串行端口（SSP） |
| 时钟速率： | 20MHz |
| 非易失内存： | 外部 |
| 芯片上RAM： | 3kB |
| 电压 - 输入/输出： | 5.00V |
| 电压 - 核心： | 5.00V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 68-LCC（J 形引线） |
| 供应商设备封装： | 68-PLCC（24.23x24.23） |
| 包装： | 管件 |
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ADSP-21xx
REV. B
–45–
Frequency
10.24 MHz
Dependency
Parameter
Min
Max
Min
Max
Unit
Timing Requirement:
tCK
CLKIN Period
97.6
150
ns
tCKL
CLKIN Width Low
20
ns
tCKH
CLKIN Width High
20
ns
tRSP
RESET Width Low
488
5tCK
1
ns
Switching Characteristic:
tCPL
CLKOUT Width Low
38.8
0.5tCK – 10
ns
tCPH
CLKOUT Width High
38.8
0.5tCK – 10
ns
tCKOH
CLKIN High to CLKOUT High
0
20
ns
NOTES
1Applies after powerup sequence is complete. Internal phase lock loop requires no more than 2000 CLKIN cycles assuming stable CLKIN (not including crystal
oscillator startup time).
TIMING PARAMETERS (ADSP-2103/2162/2164)
CLOCK SIGNALS & RESET
Figure 39. Clock Signals
CLKIN
CLKOUT
t
CKH
t
CK
t
CKL
t
CKOH
t
CPH
t
CPL
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