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参数资料
| 型号： | ADSP-21368BBPZ-2A |
| 厂商： | Analog Devices Inc |
| 文件页数： | 16/64页 |
| 文件大小： | 0K |
| 描述： | IC DSP 32BIT 333MHZ 256-BGA |
| 产品培训模块： | SHARC Processor Overview |
| 标准包装： | 1 |
| 系列： | SHARC® |
| 类型： | 浮点 |
| 接口： | DAI，DPI |
| 时钟速率： | 333MHz |
| 非易失内存： | ROM（768 kB） |
| 芯片上RAM： | 256kB |
| 电压 - 输入/输出： | 3.30V |
| 电压 - 核心： | 1.20V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 256-LBGA 裸露焊盘 |
| 供应商设备封装： | 256-BGA（27x27） |
| 包装： | 托盘 |
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Rev. F
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October 2013
Reset
Interrupts
The following timing specification applies to the FLAG0,
FLAG1, and FLAG2 pins when they are configured as IRQ0,
IRQ1, and IRQ2 interrupts.
Table 14. Reset
Parameter
Min
Max
Unit
Timing Requirements
t
WRST
1
RESET Pulse Width Low
4t
CK
ns
t
SRST
RESET Setup Before CLKIN Low
8
ns
1 Applies after the power-up sequence is complete. At power-up, the processor’s internal phase-locked loop requires no more than 100 s while RESET is low, assuming stable
V
DD and CLKIN (not including start-up time of external clock oscillator).
Figure 9. Reset
CLKIN
RESET
tSRST
tWRST
Table 15. Interrupts
Parameter
Min
Max
Unit
Timing Requirement
t
IPW
IRQx Pulse Width
2 × t
PCLK +2
ns
Figure 10. Interrupts
INTERRUPT
INPUTS
tIPW
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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