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参数资料
| 型号： | ADSP-21479KBCZ-2A |
| 厂商： | Analog Devices Inc |
| 文件页数： | 18/72页 |
| 文件大小： | 0K |
| 描述： | IC DSP SHARC 266MHZ LP 196CSPBGA |
| 标准包装： | 1 |
| 系列： | SHARC® |
| 类型： | 浮点 |
| 接口： | DAI，DPI，EBI/EMI，I²C，SPI，SPORT，UART/USART |
| 时钟速率： | 266MHz |
| 非易失内存： | ROM（4Mb） |
| 芯片上RAM： | 5Mb |
| 电压 - 输入/输出： | 3.30V |
| 电压 - 核心： | 1.20V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 196-LFBGA，CSPBGA |
| 供应商设备封装： | 196-CSPBGA（12x12） |
| 包装： | 托盘 |
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Rev. A
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September 2011
Clock Input
Figure 6. Power-Up Sequencing
Table 19. Clock Input
Parameter
100 MHz
266 MHz
300 MHz
Unit
MinMax
Timing Requirements
tCK
CLKIN Period
761
1 Applies only for CLKCFG1–0 = 00 and default values for PLL control bits in PMCTL.
100
301
100
26.661
100
ns
tCKL
CLKIN Width Low
3845
1545
13.33
45
ns
tCKH
CLKIN Width High
38
45
15
45
13.33
45
ns
tCKRF
CLKIN Rise/Fall (0.4 V to 2.0 V)
3
ns
tCCLK
2
2 Any changes to PLL control bits in the PMCTL register must meet core clock timing specification tcclk.
CCLK Period
9.5
10.2
3.75
10
3.33
10
ns
fVCO
3
3 See Figure 5 on Page 24 for VCO diagram.
VCO Frequency
196
210
200
600
200
600
MHz
tCKJ
4, 5
4 Actual input jitter should be combined with ac specifications for accurate timing analysis.
5 Jitter specification is maximum peak-to-peak time interval error (TIE) jitter.
CLKIN Jitter Tolerance
–250
+250
–250
+250
–250
+250
ps
Figure 7. Clock Input
tRSTVDD
tCLKVDD
tCLKRST
tCORERST
tPLLRST
VDDEXT
VDDINT
CLKIN
CLK_CFG1–0
RESET
RESETOUT
tIVDDEVDD
CLKIN
tCK
tCKL
tCKH
tCKJ
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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| ADSP-21479KBCZ-3AX | 制造商:Analog Devices 功能描述:- Trays |
| ADSP-21479KBCZ-ENG | 制造商:Analog Devices 功能描述:SHARC PROCESSOR - Trays |
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| ADSP-21479KSWZ-1A | 功能描述:数字信号处理器和控制器 - DSP, DSC 200MHz 100 ld Low Power Sharc Proc RoHS:否 制造商:Microchip Technology 核心:dsPIC 数据总线宽度:16 bit 程序存储器大小:16 KB 数据 RAM 大小:2 KB 最大时钟频率:40 MHz 可编程输入/输出端数量:35 定时器数量:3 设备每秒兆指令数:50 MIPs 工作电源电压:3.3 V 最大工作温度:+ 85 C 封装 / 箱体:TQFP-44 安装风格:SMD/SMT |
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