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参数资料
| 型号： | ADSP-BF523KBCZ-6 |
| 厂商： | Analog Devices Inc |
| 文件页数： | 54/88页 |
| 文件大小： | 0K |
| 描述： | IC DSP 16BIT 600MHZ 289-CSPBGA |
| 产品变化通告： | Datasheet Specification Change 14/Dec/2009 |
| 标准包装： | 1 |
| 系列： | Blackfin® |
| 类型： | 定点 |
| 接口： | DMA，I²C，PPI，SPI，SPORT，UART |
| 时钟速率： | 600MHz |
| 非易失内存： | ROM（32 kB） |
| 芯片上RAM： | 132kB |
| 电压 - 输入/输出： | 1.8V，2.5V，3.3V |
| 电压 - 核心： | 1.10V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 289-LFBGA，CSPBGA |
| 供应商设备封装： | 289-CSPBGA（12x12） |
| 包装： | 托盘 |
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ADSP-BF522/ADSP-BF523/ADSP-BF524/ADSP-BF525/ADSP-BF526/ADSP-BF527
Table 44. Serial Ports—Internal Clock for ADSP-BF522/ADSP-BF524/ADSP-BF526 Processors
V DDEXT
1.8V Nominal
V DDEXT
2.5 V or 3.3V Nominal
Parameter
Min
Max
Min
Max
Unit
Timing Requirements
t SFSI
t HFSI
TFSx/RFSx Setup Before TSCLKx/RSCLKx 1
TFSx/RFSx Hold After TSCLKx/RSCLKx 1
11.0
–1.5
9.6
–1.5
ns
ns
t SDRI
Receive Data Setup Before RSCLKx
11.0
9.6
ns
t HDRI
Receive Data Hold After RSCLKx
–1.5
–1.5
ns
Switching Characteristics
t SCLKIW
t DFSI
TSCLKx/RSCLKx Width
TFSx/RFSx Delay After TSCLKx/RSCLKx (Internally Generated TFSx/RFSx) 2
10.0
3.0
8.0
3.0
ns
ns
t HOFSI
TFSx/RFSx Hold After TSCLKx/RSCLKx (Internally Generated TFSx/RFSx) 2 –2.0
–1.0
ns
t DDTI
t HDTI
Transmit Data Delay After TSCLKx 2
Transmit Data Hold After TSCLKx 2
–1.8
3.0
–1.5
3.0
ns
ns
1
2
Referenced to sample edge.
Referenced to drive edge.
Table 45. Serial Ports—Internal Clock for ADSP-BF523/ADSP-BF525/ADSP-BF527 Processors
V DDEXT
1.8V Nominal
V DDEXT
2.5 V or 3.3V Nominal
Parameter
Min
Max
Min
Max
Unit
Timing Requirements
t SFSI
TFSx/RFSx Setup Before TSCLKx/RSCLKx 1
11.0
9.6
ns
t HFSI
t SDRI
TFSx/RFSx Hold After TSCLKx/RSCLKx
Receive Data Setup Before RSCLKx 1
–1.5
11.0
–1.5
9.6
ns
ns
t HDRI
Receive Data Hold After RSCLKx
–1.5
–1.5
ns
Switching Characteristics
t SCLKIW
t DFSI
TSCLKx/RSCLKx Width
TFSx/RFSx Delay After TSCLKx/RSCLKx
4.5
3.0
4.5
3.0
ns
ns
(Internally Generated TFSx/RFSx) 2
t HOFSI
TFSx/RFSx Hold After TSCLKx/RSCLKx
–1.0
–1.0
ns
(Internally Generated TFSx/RFSx) 2
t DDTI
Transmit Data Delay After TSCLKx 2
3.0
3.0
ns
t HDTI
Transmit Data Hold After TSCLKx
–1.8
–1.5
ns
1
2
Referenced to sample edge.
Referenced to drive edge.
Rev. D
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Page 54 of 88 | July 2013
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PDF描述 |
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