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参数资料
| 型号： | ADSP-BF561SBB600 |
| 厂商： | Analog Devices Inc |
| 文件页数： | 33/64页 |
| 文件大小： | 0K |
| 描述： | IC DSP 32BIT 600MHZ 297-BGA |
| 产品培训模块： | Blackfin® Processor Core Architecture Overview Blackfin® Device Drivers Blackfin® Optimizations for Performance and Power Consumption Blackfin® System Services |
| 标准包装： | 1 |
| 系列： | Blackfin® |
| 类型： | 定点 |
| 接口： | SPI，SSP，UART |
| 时钟速率： | 600MHz |
| 非易失内存： | 外部 |
| 芯片上RAM： | 328kB |
| 电压 - 输入/输出： | 2.50V，3.30V |
| 电压 - 核心： | 1.35V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 297-BGA |
| 供应商设备封装： | 297-PBGA（27x27） |
| 包装： | 托盘 |
| 配用： | ADZS-BFAUDIO-EZEXT-ND - BOARD EVAL AUDIO BLACKFIN ADZS-BF561-EZLITE-ND - BOARD EVAL ADSP-BF561 ADZS-BF561-MMSKIT-ND - KIT STARTER MULTIMEDIA BF561 ADZS-BFAV-EZEXT-ND - BOARD DAUGHT ADSP-BF533,37,61KIT |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页当前第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页
ADSP-BF561
DATA RECEI V E — INTERNAL CLOCK
DATA RECEI V E — E X TERNAL CLOCK
DRI V E ED G E
t SCLKI W
SAM P LE ED G E
DRI V E ED G E
t SCLK W
SAM P LE ED G E
RSCLK x
t D F SIR
RSCLK x
t D F SE
t HO F SIR
t S F SI
t H F SI
t HO F SE
t S F SE
t H F SE
R F S x
R F S x
DR x
t SDRI
t HDRI
DR x
t SDRE
t HDRE
NOTES
1. EITHER THE RISIN G ED G E OR THE F ALLIN G ED G E O F SCLK (E X TERNAL OR INTERNAL) CAN B E USED AS THE ACTI V E SAM P LIN G ED G E .
DATA TRANSMIT — INTERNAL CLOCK
DATA TRANSMIT — E X TERNAL CLOCK
DRI V E ED G E
t SCLKI W
SAM P LE ED G E
DRI V E ED G E
t SCLK W
SAM P LE ED G E
TSCLK x
t D F SI
TSCLK x
t D F SE
t HO F SI
t S F SI
t H F SI
t HO F SE
t S F SE
t H F SE
T F S x
T F S x
DT x
t HDTI
t DDTI
DT x
t HDTE
t DDTE
Figure 20. Serial Ports
TSCLK x
(IN P UT)
t SUDTE
T F S x
(IN P UT)
RSCLK x
(IN P UT)
t SUDRE
R F S x
(IN P UT)
S P ORT
ENA B LED
Figure 21. Serial Port Start Up with External Clock and Frame Sync
Rev. E |
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September 2009
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PDF描述 |
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