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参数资料
| 型号： | ADSP-BF561SKB600 |
| 厂商： | Analog Devices Inc |
| 文件页数： | 29/64页 |
| 文件大小： | 0K |
| 描述： | IC DSP CTRLR 32BIT 600MHZ 297BGA |
| 产品培训模块： | Blackfin® Processor Core Architecture Overview Blackfin® Device Drivers Blackfin® Optimizations for Performance and Power Consumption Blackfin® System Services |
| 标准包装： | 1 |
| 系列： | Blackfin® |
| 类型： | 定点 |
| 接口： | SPI，SSP，UART |
| 时钟速率： | 600MHz |
| 非易失内存： | 外部 |
| 芯片上RAM： | 328kB |
| 电压 - 输入/输出： | 2.50V，3.30V |
| 电压 - 核心： | 1.35V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 297-BGA |
| 供应商设备封装： | 297-PBGA（27x27） |
| 包装： | 托盘 |
| 配用： | ADZS-BFAUDIO-EZEXT-ND - BOARD EVAL AUDIO BLACKFIN ADZS-BF561-EZLITE-ND - BOARD EVAL ADSP-BF561 ADZS-BF561-MMSKIT-ND - KIT STARTER MULTIMEDIA BF561 ADZS-BFAV-EZEXT-ND - BOARD DAUGHT ADSP-BF533,37,61KIT |
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ADSP-BF561
FRAME
SYNC IS
SAMPLED
DATA0 IS
SAMPLED
FOR
DATA0
DATA1 IS
SAMPLED
PPIxCLK
POLC = 0
PPIxCLK
POLC = 1
t
HFSPE
t SFSPE
POLS = 1
PPIxSYNC1
POLS = 0
POLS = 1
PPIxSYNC2
POLS = 0
t
SDRPE
t
HDRPE
PPIx_DATA
Figure 15. PPI GP Rx Mode with External Frame Sync Timing (Default)
FRAME
SYNC IS
DRIVEN
OUT
DATA0 IS
DRIVEN
OUT
PPIxCLK
POLC = 0
PPIxCLK
POLC = 1
t
DFSPE
t HOFSPE
POLS = 1
PPIxSYNC1
POLS = 0
POLS = 1
PPIxSYNC2
POLS = 0
t DDTPE
t HDTPE
PPIx_DATA
DATA0
Figure 16. PPI GP Tx Mode with Internal Frame Sync Timing (Default)
Rev. E |
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September 2009
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PDF描述 |
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