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参数资料
| 型号： | ADUC834BCPZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 74/80页 |
| 文件大小： | 0K |
| 描述： | IC MCU 62K FLASH ADC/DAC 56LFCSP |
| 标准包装： | 1 |
| 系列： | MicroConverter® ADuC8xx |
| 核心处理器： | 8052 |
| 芯体尺寸： | 8-位 |
| 速度： | 12.58MHz |
| 连通性： | EBI/EMI，I²C，SPI，UART/USART |
| 外围设备： | POR，PSM，PWM，温度传感器，WDT |
| 输入/输出数： | 34 |
| 程序存储器容量： | 62KB（62K x 8） |
| 程序存储器类型： | 闪存 |
| EEPROM 大小： | 4K x 8 |
| RAM 容量： | 2.25K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 2.7 V ~ 5.25 V |
| 数据转换器： | A/D 3x16b，4x24b; D/A 1x12b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 56-VFQFN 裸露焊盘，CSP |
| 包装： | 托盘 |
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REV. A
–76–
ADuC834
Parameter
Min
Typ
Max
Unit
Figure
SPI MASTER MODE TIMING (CPHA = 0)
tSL
SCLOCK Low Pulsewidth
*
630
ns
76
tSH
SCLOCK High Pulsewidth
*
630
ns
76
tDAV
Data Output Valid after SCLOCK Edge
50
ns
76
tDOSU
Data Output Setup before SCLOCK Edge
150
ns
76
tDSU
Data Input Setup Time before SCLOCK Edge
100
ns
76
tDHD
Data Input Hold Time after SCLOCK Edge
100
ns
76
tDF
Data Output Fall Time
10
25
ns
76
tDR
Data Output Rise Time
10
25
ns
76
tSR
SCLOCK Rise Time
10
25
ns
76
tSF
SCLOCK Fall Time
10
25
ns
76
*Characterized under the following conditions:
a. Core clock divider bits CD2, CD1 and CD0 in PLLCON SFR set to 0, 1, and 1 respectively, i.e., core clock frequency = 1.57 MHz, and
b. SPI bit-rate selection bits SPR1 and SPR0 in SPICON SFR set to 0 and 0 respectively.
SCLOCK
(CPOL = 0)
SCLOCK
(CPOL = 1)
MOSI
MISO
MSB IN
BITS 6–1
LSB IN
LSB
MSB
tDAV
tDF
tDR
tSR
tSF
tDHD
tDSU
tSH
tSL
Figure 76. SPI Master Mode Timing (CPHA = 0)
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PDF描述 |
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参数描述 |
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