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参数资料
| 型号： | ADV202BBCZ-150 |
| 厂商： | Analog Devices Inc |
| 文件页数： | 29/40页 |
| 文件大小： | 0K |
| 描述： | IC VIDEO CODEC JPEG2000 144CSBGA |
| 标准包装： | 1 |
| 类型： | JPEG2000 视频编解码器 |
| 分辨率（位）： | 16 b |
| 三角积分调变： | 无 |
| 电压 - 电源，模拟： | 1.5V，3.3V |
| 电压 - 电源，数字： | 1.5V，3.3V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 144-BGA，CSPBGA |
| 供应商设备封装： | 144-CSPBGA（13x13） |
| 包装： | 托盘 |
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Data Sheet
ADV202
Rev. D | Page 35 of 40
DECODE—MULTICHIP MASTER/SLAVE
In a master/slave configuration, it is expected that the master HVF
outputs are connected to the slave HVF inputs and that each
SCOMM[5] pin is connected to the same GPIO on the host.
In a slave/slave configuration, the common HVF for both
ADV202s is generated by an external house sync, and each
SCOMM[5] is connected to the same GPIO output on the host.
SWIRQ1, Software Interrupt 1 in the EIRQIE register, must be
unmasked on both devices to enable multichip mode.
04723-
003
DATA[31:0]
HDATA[31:0]
ADDR[3:0]
CS
RD
WR
WE
ACK
IRQ
CS
RD
WR
ACK
IRQ
DREQ
DACK
IRQ
DREQ
FIELD
VSYNC
HSYNC
DACK
G I/O
SCOMM[5]
VCLK
1080i
VIDEO OUT
MCLK
VDATA[11:2]
32-BIT HOST CPU
10-BIT SD/HD
VIDEO
ENCODER
ADV202
_1_MASTER
SCOMM[5]
HDATA[31:0]
ADDR[3:0]
CS
RD
WE
ACK
IRQ
FIELD
VSYNC
HSYNC
DREQ
DACK
VCLK
MCLK
VDATA[11:2]
ADV202
CLKIN
Y[9:0]
C[9:0]
CbCr
Y
74.25MHz
OSC
Figure 25. Decode—Multichip Master/Slave Application
DIGITAL STILL CAMERA/CAMCORDER
Figure 26 is a typical configuration for a digital camera or camcorder.
04723-
004
D[9:0]
10
DATA INPUTS[9:0]
MCLK
VCLK
VFRM
VRDY
VSTRB
VDATA[15:6]
SDATA
SERIAL DATA
SCK
SERIAL CLK
SL
SERIAL EN
AD9843A
FPGA
16-BIT
HOST CPU
ADV202
DATA[15:0]
HDATA[15:0]
ADDR[3:0]
CS
RD
WE
ACK
IRQ
Figure 26. Digital Still Camera/Camcorder Encode Application for 10-Bit Pixel Data Using Raw Pixel Mode
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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| ADV202BCZ-150 | 制造商:Analog Devices 功能描述:JPEG 2000 CODEC CONVERTER, LEAD FREE - Trays |
| ADV202-HD-EB | 制造商:Analog Devices 功能描述: |
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