参数资料
| 型号： | ADV3203ASWZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 16/20页 |
| 文件大小： | 0K |
| 描述： | IC CROSSPOINT SWIT 32X16 176LQFP |
| 标准包装： | 1 |
| 功能： | 交叉点开关 |
| 电路： | 1 x 32:16 |
| 电压电源： | 单/双电源 |
| 电压 - 电源，单路/双路(±)： | 5V，±2.5V，±3.3V |
| 电流 - 电源： | 200mA |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 176-LQFP |
| 供应商设备封装： | 176-LQFP-EP（24x24） |
| 包装： | 托盘 |
ADV3202/ADV3203
Rev. 0 | Page 5 of 20
TIMING CHARACTERISTICS (SERIAL MODE)
Specifications subject to change without notice.
Table 3.
Limit
Parameter
Symbol
Min
Typ
Max
Unit
Serial Data Setup Time
t1
40
ns
CLK Pulse Width
t2
50
ns
Serial Data Hold Time
t3
50
ns
CLK Pulse Separation
t4
150
ns
CLK to UPDATE Delay
t5
50
160
ns
UPDATE Pulse Width
t6
40
ns
CLK to DATA OUT Valid
t7
130
ns
Propagation Delay, UPDATE to Switch On or Off
50
ns
Data Load Time, CLK = 5 MHz, Serial Mode
38.6
μs
RESET Time
160
ns
TRANSFER DATA FROM SERIAL
REGISTER TO PARALLEL
LATCHES DURING LOW LEVEL
OUT00 (D0)
OUT15 (D5)
CLAMP
ON/OFF
1
0
1
0
1
0
1 = LATCHED
0 = TRANSPARENT
DATA OUT
UPDATE
DATA IN
CLK
CS
t1
t3
t7
t5
t6
LOAD DATA INTO
SERIAL REGISTER
ON RISING EDGE
t2
t4
75
26
-0
02
0
Figure 2. Timing Diagram, Serial Mode
Table 4. Logic Levels, DVCC = 3.3 V
VIH
VIL
VOH
VOL
IIH
IIL
IOH
IOL
RESET, CS,
CLK, DATA IN,
UPDATE, OSDS
RESET, CS,
CLK, DATA IN,
UPDATE, OSDS
DATA OUT
RESET, CS,
CLK, DATA IN,
UPDATE, OSDS
RESET, CS,
CLK, DATA IN,
UPDATE, OSDS
DATA OUT
2.5 V min
0.8 V max
2.7 V min
0.5 V max
0.5 μA typ
3 mA typ
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