参数资料
| 型号： | ADV3225ACPZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 23/24页 |
| 文件大小： | 0K |
| 描述： | IC CROSSPOINT SW 16X8 72LFCSP |
| 标准包装： | 1 |
| 功能： | 交叉点开关 |
| 电路： | 1 x 16:8 |
| 电压电源： | 双电源 |
| 电压 - 电源，单路/双路(±)： | ±5V |
| 电流 - 电源： | 58mA |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 72-VFQFN 裸露焊盘，CSP |
| 供应商设备封装： | 72-LFCSP-VQ（10x10） |
| 包装： | 托盘 |
ADV3224/ADV3225
Rev. A | Page 8 of 24
PIN CONFIGURATION AND FUNCTION DESCRIPTIONS
OU
T4
AV
CC
OU
T3
A
VEE
OU
T2
AV
CC
OU
T1
A
VEE
OU
T0
AV
CC
A
VEE
AV
CC
OU
T7
A
VEE
OU
T6
AV
CC
OU
T5
A
VEE
IN8
AVEE
IN9
AVEE
IN10
AVCC
IN11
AVCC
IN12
IN13
AVCC
IN14
AVEE
IN15
AGND
AVEE
TOP VIEW
(Not to Scale)
NOTES
1. EXPOSED PADDLE. THE EXPOSED METAL PADDLE ON THE BOTTOM OF
THE LFCSP PACKAGE MUST BE SOLDERED TO THE PCB AGND FOR
PROPER HEAT DISSIPATION AND FOR NOISE AND MECHANICAL
STRENGTH BENEFITS.
DVCC
DGND
D4
D3
D2
D1
D0
A2
A1
A0
SER/PAR
UPDATE
DATAIN
CLK
DGND
RESET
CE
DATAOUT
09317-
005
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32
33
34
35
36
54
53
52
51
50
49
48
47
46
45
44
43
42
41
40
39
38
37
72
71
70
69
68
67
66
65
64
63
62
61
60
59
58
57
56
55
PIN 1
INDICATOR
ADV3224/ADV3225
AG
ND
IN6
A
VEE
IN7
AV
CC
IN5
A
VEE
AV
CC
IN3
A
VEE
IN2
AV
CC
IN1
A
VEE
IN0
AG
ND
DV
CC
IN4
Figure 5. Pin Configuration
Table 7. Pin Function Descriptions
Pin No.
Mnemonic
Description
1, 5, 9, 13, 19, 23, 27, 31,
35, 60, 64, 68
AVCC
Analog Positive Supply.
2
IN8
Input Number 8.
3, 7, 11, 15, 18, 21, 25,
29, 33, 36, 58, 62, 66, 70
AVEE
Analog Negative Supply.
4
IN9
Input Number 9.
6
IN10
Input Number 10.
8
IN11
Input Number 11.
10
IN12
Input Number 12.
12
IN13
Input Number 13.
14
IN14
Input Number 14.
16
IN15
Input Number 15.
17, 56, 72
AGND
Analog Ground.
20
OUT7
Output Number 7.
22
OUT6
Output Number 6.
24
OUT5
Output Number 5.
26
OUT4
Output Number 4.
28
OUT3
Output Number 3.
30
OUT2
Output Number 2.
32
OUT1
Output Number 1.
34
OUT0
Output Number 0.
37, 55
DVCC
Digital Positive Supply.
38, 54
DGND
Digital Ground.
39
D4
Parallel Data Input, Output Enable.
40 to 43
D3 to D0
Parallel Data Input.
44 to 46
A2 to A0
Parallel Output Address Input.
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