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参数资料
| 型号： | AGLE600V5-FGG484C |
| 元件分类： | FPGA |
| 英文描述： | FPGA, 13824 CLBS, 600000 GATES, PBGA484 |
| 封装： | 23 X 23 MM, 2.23 MM HEIGHT, 1 MM PITCH, ROHS COMPLIANT, FBGA-484 |
| 文件页数： | 148/156页 |
| 文件大小： | 5023K |
| 代理商： | AGLE600V5-FGG484C |
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IGLOOe DC and Switching Characteristics
Ad vance v0.3
2-77
DDR Module Specifications
Input DDR Module
Figure 2-31 Input DDR Timing Model
Table 2-121 Parameter Definitions
Parameter Name
Parameter Definition
Measuring Nodes (from, to)
tDDRICLKQ1
Clock-to-Out Out_QR
B, D
tDDRICLKQ2
Clock-to-Out Out_QF
B, E
tDDRISUD
Data Setup Time of DDR input
A, B
tDDRIHD
Data Hold Time of DDR input
A, B
tDDRICLR2Q1
Clear-to-Out Out_QR
C, D
tDDRICLR2Q2
Clear-to-Out Out_QF
C, E
tDDRIREMCLR
Clear Removal
C, B
tDDRIRECCLR
Clear Recovery
C, B
Input DDR
Data
CLK
CLKBUF
INBUF
Out_QF
(to core)
FF2
FF1
INBUF
CLR
DDR_IN
E
A
B
C
D
Out_QR
(to core)
相关PDF资料 |
PDF描述 |
|---|---|
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| ACBQ20TTEB270K/401M | RC NETWORK, BUSSED, 1W, 27ohm, 20V, 0.0004uF, SURFACE MOUNT, 20 |
| ACBQ20TTEB270K/430M | RC NETWORK, BUSSED, 1W, 27ohm, 20V, 0.000043uF, SURFACE MOUNT, 20 |
| ACBQ20TTEB270K/470M | RC NETWORK, BUSSED, 1W, 27ohm, 20V, 0.000047uF, SURFACE MOUNT, 20 |
| ACBQ20TTEB270K/510M | RC NETWORK, BUSSED, 1W, 27ohm, 20V, 0.000051uF, SURFACE MOUNT, 20 |
相关代理商/技术参数 |
参数描述 |
|---|---|
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