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参数资料
型号： AGLN125V2-VQG100
厂商： Microsemi SoC
文件页数： 70/150页
文件大小： 0K
描述： IC FPGA 125K 1.2-1.5V 100VTQFP
标准包装： 90
系列： IGLOO nano
逻辑元件/单元数： 3072
RAM 位总计： 36864
输入/输出数： 71
门数： 125000
电源电压： 1.14 V ~ 1.575 V
安装类型： 表面贴装
工作温度： -20°C ~ 70°C
封装/外壳： 100-TQFP
供应商设备封装： 100-VQFP（14x14）
其它名称： 1100-1131
IGLOO nano DC and Switching Characteristics
2-10
Revision 17
Power Consumption of Various Internal Resources
Table 2-15 Different Components Contributing to Dynamic Power Consumption in IGLOO nano Devices
For IGLOO nano V2 or V5 Devices, 1.5 V Core Supply Voltage
Parameter
Definition
Device Specific Dynamic Power (W/MHz)
AGLN250 AGLN125 AGLN060 AGLN020 AGLN015 AGLN010
PAC1
Clock contribution of a Global Rib
4.421
4.493
2.700
0
PAC2
Clock contribution of a Global Spine
2.704
1.976
1.982
4.002
2.633
PAC3
Clock contribution of a VersaTile row
1.496
1.504
1.511
1.346
1.340
PAC4
Clock contribution of a VersaTile
used as a sequential module
0.152
0.153
0.148
0.143
PAC5
First contribution of a VersaTile used
as a sequential module
0.057
PAC6
Second contribution of a VersaTile
used as a sequential module
0.207
PAC7
Contribution of a VersaTile used as
a combinatorial module
0.17
PAC8
Average contribution of a routing net
0.7
PAC9
Contribution of an I/O input pin
(standard-dependent)
See Table 2-13 on page 2-9.
PAC10
Contribution of an I/O output pin
(standard-dependent)
See Table 2-14.
PAC11
Average contribution of a RAM block
during a read operation
25.00
N/A
PAC12
Average contribution of a RAM block
during a write operation
30.00
N/A
PAC13
Dynamic contribution for PLL
2.70
N/A
Table 2-16 Different Components Contributing to the Static Power Consumption in IGLOO nano Devices
For IGLOO nano V2 or V5 Devices, 1.5 V Core Supply Voltage
Parameter
Definition
Device -Specific Static Power (mW)
AGLN250 AGLN125 AGLN060 AGLN020 AGLN015 AGLN010
PDC1
Array static power in Active mode
See Table 2-12 on page 2-8
PDC2
Array static power in Static (Idle)
mode
See Table 2-12 on page 2-8
PDC3
Array static power in Flash*Freeze
mode
See Table 2-9 on page 2-7
PDC4 1
Static PLL contribution
1.84
N/A
PDC5
Bank quiescent power
(VCCI-dependent)2
See Table 2-12 on page 2-8
Notes:
1. Minimum contribution of the PLL when running at lowest frequency.
2. For a different output load, drive strength, or slew rate, Microsemi recommends using the Microsemi power spreadsheet
calculator or the SmartPower tool in Libero SoC.
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AGLN125V2-ZCSG81 功能描述:IC FPGA NANO 1KB 125K 81-CSP RoHS:是 类别:集成电路 (IC) >> 嵌入式 - FPGA（现场可编程门阵列） 系列:IGLOO nano 标准包装:152 系列:IGLOO PLUS LAB/CLB数:- 逻辑元件/单元数:792 RAM 位总计:- 输入/输出数:120 门数:30000 电源电压:1.14 V ~ 1.575 V 安装类型:表面贴装 工作温度:-40°C ~ 85°C 封装/外壳:289-TFBGA，CSBGA 供应商设备封装:289-CSP（14x14）
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