参数资料
型号: AT89C51RB2-SLRIL
厂商: Atmel
文件页数: 108/127页
文件大小: 0K
描述: IC MCU FLASH 8051 16K 3V 44-PLCC
标准包装: 1
系列: 89C
核心处理器: 8051
芯体尺寸: 8-位
速度: 40MHz
连通性: SPI,UART/USART
外围设备: POR,PWM,WDT
输入/输出数: 32
程序存储器容量: 16KB(16K x 8)
程序存储器类型: 闪存
RAM 容量: 1.25K x 8
电压 - 电源 (Vcc/Vdd): 2.7 V ~ 3.6 V
振荡器型: 外部
工作温度: -40°C ~ 85°C
封装/外壳: 44-LCC(J 形引线)
包装: 剪切带 (CT)
配用: AT89STK-11-ND - KIT STARTER FOR AT89C51RX2
其它名称: AT89C51RB2SLRILCT
81
AT89C51RB2/RC2
4180E–8051–10/06
Table 1. Minimum Reset Capacitor Value for a 50 k
Ω Pull-down Resistor(1)
Note:
These values assume VDD starts from 0V to the nominal value. If the time between 2
on/off sequences is too fast, the power-supply de-coupling capacitors may not be fully
discharged, leading to a bad reset sequence.
Warm Reset
To achieve a valid reset, the reset signal must be maintained for at least 2 machine
cycles (24 oscillator clock periods) while the oscillator is running. The number of clock
periods is mode independent (X2 or X1).
Watchdog Reset
As detailed in Section “Hardware Watchdog Timer”, page 77, the WDT generates a 96-
clock period pulse on the RST pin. In order to properly propagate this pulse to the rest of
the application in case of external capacitor or power-supply supervisor circuit, a 1 k
Ω
resistor must be added as shown Figure 33.
Figure 33. Reset Circuitry for WDT Reset-out Usage
Oscillator
Start-Up Time
VDD Rise Time
1 ms
10 ms
100 ms
5 ms
820 nF
1.2 F
12 F
20 ms
2.7 F
3.9 F
12 F
R
RS
T
RST
VSS
To CPU Core
and Peripherals
VDD
+
P
VDD
From WDT
Reset Source
VSS
VDD
RST
1K
To Other
On-board
Circuitry
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PDF描述
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