参数资料
| 型号： | AT89C52-24PC |
| 厂商： | Atmel |
| 文件页数： | 10/24页 |
| 文件大小： | 0K |
| 描述： | IC MICRO CTRL 24MHZ 40DIP |
| 标准包装： | 9 |
| 系列： | 89C |
| 核心处理器： | 8051 |
| 芯体尺寸： | 8-位 |
| 速度： | 24MHz |
| 连通性： | SIO，UART/USART |
| 输入/输出数： | 32 |
| 程序存储器容量： | 8KB（8K x 8） |
| 程序存储器类型： | 闪存 |
| RAM 容量： | 256 x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 4 V ~ 6 V |
| 振荡器型： | 内部 |
| 工作温度： | 0°C ~ 70°C |
| 封装/外壳： | 40-DIP（0.600"，15.24mm） |
| 包装： | 管件 |
AT89C52
18
AC Characteristics
Under operating conditions, load capacitance for Port 0, ALE/PROG, and PSEN = 100 pF; load capacitance for all other
outputs = 80 pF.
External Program and Data Memory Characteristics
Symbol
Parameter
12 MHz Oscillator
Variable Oscillator
Units
Min
Max
Min
Max
1/tCLCL
Oscillator Frequency
0
24
MHz
t
LHLL
ALE Pulse Width
127
2t
CLCL-40
ns
t
AVLL
Address Valid to ALE Low
43
t
CLCL-13
ns
tLLAX
Address Hold After ALE Low
48
tCLCL-20
ns
t
LLIV
ALE Low to Valid Instruction In
233
4t
CLCL-65
ns
t
LLPL
ALE Low to PSEN Low
43
t
CLCL-13
ns
tPLPH
PSEN Pulse Width
205
3tCLCL-20
ns
t
PLIV
PSEN Low to Valid Instruction In
145
3t
CLCL-45
ns
t
PXIX
Input Instruction Hold after PSEN
00
ns
tPXIZ
Input Instruction Float after PSEN
59
tCLCL-10
ns
t
PXAV
PSEN to Address Valid
75
t
CLCL-8
ns
t
AVIV
Address to Valid Instruction In
312
5t
CLCL-55
ns
tPLAZ
PSEN Low to Address Float
10
ns
t
RLRH
RD Pulse Width
400
6t
CLCL-100
ns
t
WLWH
WR Pulse Width
400
6t
CLCL-100
ns
tRLDV
RD Low to Valid Data In
252
5tCLCL-90
ns
t
RHDX
Data Hold After RD
00
ns
t
RHDZ
Data Float After RD
97
2t
CLCL-28
ns
tLLDV
ALE Low to Valid Data In
517
8tCLCL-150
ns
t
AVDV
Address to Valid Data In
585
9t
CLCL-165
ns
t
LLWL
ALE Low to RD or WR Low
200
300
3t
CLCL-50
3t
CLCL+50
ns
tAVWL
Address to RD or WR Low
203
4tCLCL-75
ns
t
QVWX
Data Valid to WR Transition
23
t
CLCL-20
ns
t
QVWH
Data Valid to WR High
433
7t
CLCL-120
ns
tWHQX
Data Hold After WR
33
tCLCL-20
ns
t
RLAZ
RD Low to Address Float
0
ns
t
WHLH
RD or WR High to ALE High
43
123
t
CLCL-20
t
CLCL+25
ns
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