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参数资料
| 型号： | AT89LP213-20PU |
| 厂商： | Atmel |
| 文件页数： | 8/98页 |
| 文件大小： | 0K |
| 描述： | MCU 8051 2K FLASH 20MHZ 14-PDIP |
| 产品培训模块： | MCU Product Line Introduction |
| 标准包装： | 25 |
| 系列： | 89LP |
| 核心处理器： | 8051 |
| 芯体尺寸： | 8-位 |
| 速度： | 20MHz |
| 连通性： | SPI |
| 外围设备： | 欠压检测/复位，POR，PWM，WDT |
| 输入/输出数： | 12 |
| 程序存储器容量： | 2KB（2K x 8） |
| 程序存储器类型： | 闪存 |
| RAM 容量： | 128 x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 2.4 V ~ 5.5 V |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 14-DIP（0.300"，7.62mm） |
| 包装： | 管件 |
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16
3538E–MICRO–11/10
AT89LP213/214
10.2
Brown-out Reset
The AT89LP213/214 has an on-chip Brown-out Detection (BOD) circuit for monitoring the V
CC
level during operation by comparing it to a fixed trigger level. The trigger level for the BOD is
nominally 2.2V. The purpose of the BOD is to ensure that if V
CC fails or dips while executing at
speed, the system will gracefully enter reset without the possibility of errors induced by incorrect
execution. A BOD sequence is shown in Figure 10-3. When V
CC decreases to a value below the
trigger level V
BOD, the internal reset is immediately activated. When VCC increases above the
trigger level, the start-up timer releases the internal reset after the specified time-out period has
expired (Table 10-1). The Brown-out Detector must be enabled by setting the BOD Enable Fuse.
Figure 10-3. Brown-out Detector Reset
10.3
External Reset
The P1.3/RST pin can function as either an active-LOW reset input or as a digital general pur-
pose I/O, P1.3. The Reset Pin Enable Fuse, when set to “1”, enables the external reset input
function on P1.3. (See “User Configuration Fuses” on page 72). When cleared, P1.3 may be
used as an input or output pin. When configured as a reset input, the pin must be held low for at
least two clock cycles to trigger the internal reset.
Note:
During a power-up sequence, the fuse selection is always overridden and therefore the pin will
always function as a reset input. An external circuit connected to this pin should not hold this
pin LOW during a power-on sequence as this will keep the device in reset until the pin tran-
sitions high. After the power-up delay, this input will function either as an external reset input or
as a digital input as defined by the fuse bit. Only a power-up reset will temporarily override the
selection defined by the reset fuse bit. Other sources of reset will not override the reset fuse bit.
P1.3/RST also serves as the In-System Programming (ISP) enable. ISP is enabled when the
external reset pin is held low. When the reset pin is disabled by the fuse, ISP may only be entered
by pulling P1.3 low during power-up.
Table 10-1.
Start-up Timer Settings
SUT Fuse 1
SUT Fuse 0
Clock Source
t
SUT (± 5%)
00
Internal RC/External Clock
16 s
Crystal Oscillator
1024 s
01
Internal RC/External Clock
512 s
Crystal Oscillator
2048 s
10
Internal RC/External Clock
1024 s
Crystal Oscillator
4096 s
11
Internal RC/External Clock
4096 s
Crystal Oscillator
16384 s
VCC
TIME-OUT
VPOR
INTERNAL
RESET
tSUT
VBOD
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