参数资料
| 型号： | ATTINY84A-SSU |
| 厂商： | Atmel |
| 文件页数： | 107/135页 |
| 文件大小： | 0K |
| 描述： | IC MCU 8BIT 8K FLASH 14SOIC |
| 标准包装： | 55 |
| 系列： | AVR® ATtiny |
| 核心处理器： | AVR |
| 芯体尺寸： | 8-位 |
| 速度： | 20MHz |
| 连通性： | USI |
| 外围设备： | 欠压检测/复位，POR，PWM，温度传感器，WDT |
| 输入/输出数： | 12 |
| 程序存储器容量： | 8KB（4K x 16） |
| 程序存储器类型： | 闪存 |
| EEPROM 大小： | 512 x 8 |
| RAM 容量： | 512 x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 1.8 V ~ 5.5 V |
| 数据转换器： | A/D 8x10b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 14-SOIC（0.154"，3.90mm 宽） |
| 包装： | 管件 |
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MB91470/480 Series
72
(7) Multiplex Bus Access Read/Write Operation
(VCC
= 4.0 V to 5.5 V, VSS = AVSS10 = AVSS12 = 0.0 V, TA = 40 °C to + 85 °C)
Notes :
This rating is not guaranteed when the CSX → RDX/WRX Setup Delay setting by AWR : bit1 is “0”.
Normal bus interface ratings are applicable except this rating.
For tCYC (cycle time), refer to “(2) Clock Output Timing”.
Parameter
Symbol
Pin Name
Condition
Value
Unit
Min
Max
A15 to A00 address
setup time
→ SYSCLK ↑
tASCH
SYSCLK,
D31 to D16
3
ns
SYSCLK
↑ → A15 to A00 address
hold Time
tCHAX
31/2
× tCYC + 10
ns
A15 to A00 address
setup time
→ ASX ↑
tASASH
ASX,
D31 to D16
12
ns
ASX
↑ → A15 to A00 address
hold time
tASHAX
tCYC
5tCYC + 5ns
tCYC
SYSCLK
AS
D31 to D16
(A15 to A00)
tASASH
tCHAX
tASCH
tASHAX
VOH
VOL
VOH
VOL
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PDF描述 |
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参数描述 |
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