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参数资料
| 型号： | C8051F330-TB |
| 厂商： | Silicon Laboratories Inc |
| 文件页数： | 130/210页 |
| 文件大小： | 0K |
| 描述： | BOARD PROTOTYPING W/C8051F330 |
| 标准包装： | 1 |
| 类型： | MCU |
| 适用于相关产品： | C8051F330 |
| 所含物品： | 板 |
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C8051F330/1/2/3/4/5
28
Rev. 1.7
1.7.
10-Bit Analog to Digital Converter
The C8051F330/2/4 devices include an on-chip 10-bit SAR ADC with a 16-channel differential input multi-
plexer. With a maximum throughput of 200 ksps, the ADC offers true 10-bit linearity with an INL and DNL of
±1 LSB. The ADC system includes a configurable analog multiplexer that selects both positive and nega-
tive ADC inputs. Ports0-1 are available as an ADC inputs; additionally, the on-chip Temperature Sensor
output and the power supply voltage (VDD) are available as ADC inputs. User firmware may shut down the
ADC to save power.
Conversions can be started in six ways: a software command, an overflow of Timer 0, 1, 2, or 3, or an
external convert start signal. This flexibility allows the start of conversion to be triggered by software
events, a periodic signal (timer overflows), or external HW signals. Conversion completions are indicated
by a status bit and an interrupt (if enabled). The resulting 10-bit data word is latched into the ADC data
SFRs upon completion of a conversion.
Window compare registers for the ADC data can be configured to interrupt the controller when ADC data is
either within or outside of a specified range. The ADC can monitor a key voltage continuously in back-
ground mode, but not interrupt the controller unless the converted data is within/outside the specified
range.
Figure 1.14. 10-Bit ADC Block Diagram
ADC0CF
AD
0LJST
AD
0SC
0
AD
0SC
1
AD
0SC
2
AD
0SC
3
AD
0SC
4
10-Bit
SAR
ADC
RE
F
SYSC
LK
ADC0H
32
ADC0CN
AD
0C
M
0
AD
0C
M
1
AD
0C
M
2
AD
0W
IN
T
AD
0BU
S
Y
AD
0IN
T
AD
0TM
AD
0EN
Timer 0 Overflow
Timer 2 Overflow
Timer 1 Overflow
Start
Conversion
000
AD0BUSY (W)
VDD
ADC0LTH
18-to-1
AMUX
AD0WINT
Temp
Sensor
18-to-1
AMUX
VDD
P0.0
P0.7
001
010
011
100
CNVSTR Input
Window
Compare
Logic
P1.0
P1.7
GND
P0.0
P0.7
P1.0
P1.7
101
Timer 3 Overflow
ADC0LTL
ADC0GTH ADC0GTL
ADC0L
AMX0P
AM
X0P4
AM
X0P3
AM
X0P2
AM
X0P1
AM
X0P0
AMX0N
AM
X0N
4
AM
X0N
3
AM
X0N
2
AM
X0N
1
AM
X0N
0
(+)
(-)
VREF
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PDF描述 |
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| C8051F310-TB | BOARD PROTOTYPING W/C8051F310 |
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参数描述 |
|---|---|
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