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参数资料
| 型号： | C9815DY |
| 英文描述： | Up to 5A ULDO linear regulator |
| 中文描述： | CPU系统时钟发生器| SSOP封装| 56PIN |塑料 |
| 文件页数： | 1/19页 |
| 文件大小： | 328K |
| 代理商： | C9815DY |
Low EMI Clock Generator for Intel
133MHz/2DIMM Chipset Systems
Cypress Semiconductor Corporation
525 Los Coches St.
Milpitas, CA 95035. Tel: 408-263-6300, Fax: 408-263-6571
http://www.cypress.com
Document#: 38-07054 Rev. **
05/03/2001
Page 1 of 19
APPROVED PRODUCT
C9815
Product Features
Meets Intel’s 133MHz/SDRAM chipset specification
3 copies of CPU Clock (CPU[0:1] and CPU2_ITP)
9 copies of SDRAM Clock (SDRAM[0:7] and DCLK)
7 copies of PCI Clock
3 copies of 3V66 Clock
2 copies of IOAPIC Clock
1 REF Clock
1 USB Clock (Non SSC)
1 DOT Clock (Non SSC)
Cypress Spread Spectrum for best EMI reduction
SMBUS Support with read back
56 Pin SSOP package
Block Diagram
Fig.1
Frequency Table (MHz)
SEL2
SEL1
X
0
X
0
0
1
0
1
1
1
1
1
SEL0
0
1
0
1
0
1
CPU
SDRAM
Tri-state
Test Mode
100 MHz*
100 MHz*
133.3 MHz
100 MHz*
PCI
66.6 MHz
100 MHz
133.3 MHz
133.3 MHz
Table 1
33.3
33.3
33.3
33.3
Note: The following clocks remain fixed frequencies
except in Test Mode: 3V66=66.6MHz, USB/DOT=48MHz,
REF=14.318MHz and IOAPIC=33.3MHz.
*SMBUS programmable to 133 MHz, Byte 3, Bit 0
Pin Configuration
REF/SEL2
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32
33
34
35
36
37
38
39
40
41
42
43
44
45
46
47
48
XIN
VDD
SEL1
XOUT
VSS
VSS
3V66_0
3V66_1
3V66_2(AGP)
PCI0(ICH)
PCI1
VSS
PCI2
PCI3
VSS
PCI4
PCI5
PCI6
VDD
VDD
VDD
VDDA
VSSA
VSS
USB
DOT
VDD
SEL0
VDD
PD#
DCLK
VSS
SDRAM7
SDRAM6
SDRAM5
VDDS
VSS
SDRAM4
SDRAM2
SDRAM3
VDDS
SDRAM0
SDRAM1
VSS
CPU2(ITP)
VSS
CPU1
VDDC
CPU0
VDDI
IOAPIC1
IOAPIC0
VSS
C
9
8
1
5
SDATA
SCLK
49
50
51
52
53
54
55
56
VDDC
VDDS
VDD
VDD
VDDI
VDD
VDD
VDD
PLL1
Rin
i2c-clk
i2c-data
apic
s1
s0
pwr_dwn#
cpu
sdram
3V66
pci
s2
PLL2
Rin
48
PD#
i2c-clk
i2c-data
300K
36pF
36pF
3
9
2
8
2
1
1
1
XIN
XOUT
CPU(0:2)
SDRAM(0:7), DCLK
3V66(0:2)
PCI(0:6)
IOAPIC(0:1)
SDATA
SCLK
PD#
SEL0
SEL1
DOT
USB
REF / SEL2
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