- 您现在的位置：买卖IC网 > PDF目录17102 > CDB4398 (Cirrus Logic Inc)BOARD EVAL FOR CS4398 DAC PDF资料下载
参数资料
| 型号： | CDB4398 |
| 厂商： | Cirrus Logic Inc |
| 文件页数： | 31/46页 |
| 文件大小： | 0K |
| 描述： | BOARD EVAL FOR CS4398 DAC |
| 标准包装： | 1 |
| DAC 的数量： | 2 |
| 位数： | 24 |
| 采样率（每秒）： | 192k |
| 数据接口： | I²C，SPI? |
| DAC 型： | 电压 |
| 工作温度： | -10°C ~ 70°C |
| 已供物品： | 板，线缆 |
| 已用 IC / 零件： | CS4398 |
| 产品目录页面： | 757 (CN2011-ZH PDF) |
| 相关产品： | 598-1067-5-ND - IC DAC 120DB 192KHZ W/VC 28TSSOP |
| 其它名称： | 598-1155 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页当前第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页
DS568F1
37
CS4398
7.8
Misc. Control - Register 08h
7.8.1
Power Down (PDN) Bit 7
Function:
When set to 1 (default), the entire device enters a low-power state, and the contents of the control regis-
ters is retained. The power-down bit defaults to ‘1’ on power-up and must be disabled before normal op-
eration in Control Port mode can occur. This bit is ignored if CPEN is not set.
7.8.2
Control Port Enable (CPEN) Bit 6
Function:
This bit is set to 0 by default, allowing the device to power-up in Stand-Alone Mode. Control Port Mode
can be accessed by setting this bit to 1. This allows operation of the device to be controlled by the regis-
ters, and the pin definitions will conform to Control Port Mode.
7.8.3
Freeze Controls (Freeze) Bit 5
Function:
When set to 1, this function allows modifications to be made to the registers without the changes taking
effect until FREEZE is set back to 0. To make multiple changes in the Control Port registers take effect
simultaneously, enable the FREEZE bit, make all register changes, then disable the FREEZE bit.
When set to 0 (default), register changes take effect immediately.
7.8.4
Master Clock Divide-by-2 ENABLE (MCLKDIV2) Bit 4
Function:
When set to 1, the MCLKDIV bit enables a circuit which divides the externally applied MCLK signal by 2
prior to all other internal circuitry.
When set to 0 (default), MCLK is unchanged.
7.8.5
Master Clock Divide-by-3 ENABLE (MCLKDIV3) Bit 3
Function:
When set to 1, the MCLKDIV bit enables a circuit that divides the externally applied MCLK signal by 3
prior to all other internal circuitry.
When set to 0 (default), MCLK is unchanged.
7
6
5
432
10
PDN
CPEN
FREEZE
MCLKDIV2
MCLKDIV3
Reserved
10
00
相关PDF资料 |
PDF描述 |
|---|---|
| AT-S-26-4/4/S-25-R | MOD CORD STANDARD 4-4 SILVER 25' |
| GBM24DCCS-S189 | CONN EDGECARD 48POS R/A .156 SLD |
| AD9744ACP-PCBZ | BOARD EVAL FOR AD9744ACP |
| ORT42G5-EV | BOARD EVAL ORT42G5/CABLE/ADAPTER |
| REF194GS-REEL | IC VREF SERIES PREC 4.5V 8-SOIC |
相关代理商/技术参数 |
参数描述 |
|---|---|
| CDB43L21 | 功能描述:音频 IC 开发工具 Eval Bd 98dB 96kHz Low-Pwr DAC RoHS:否 制造商:Texas Instruments 产品:Evaluation Kits 类型:Audio Amplifiers 工具用于评估:TAS5614L 工作电源电压:12 V to 38 V |
| CDB43L22 | 功能描述:音频 IC 开发工具 Eval Bd LP DAC w/ClassD Spkr Driver RoHS:否 制造商:Texas Instruments 产品:Evaluation Kits 类型:Audio Amplifiers 工具用于评估:TAS5614L 工作电源电压:12 V to 38 V |
| CDB43L42 | 功能描述:音频 IC 开发工具 Eval Bd LP DAC w/Head phn.&Ln Amp RoHS:否 制造商:Texas Instruments 产品:Evaluation Kits 类型:Audio Amplifiers 工具用于评估:TAS5614L 工作电源电压:12 V to 38 V |
| CDB43L43 | 功能描述:音频 IC 开发工具 Eval Bd LP DAC w/Head phn.&Ln Amp RoHS:否 制造商:Texas Instruments 产品:Evaluation Kits 类型:Audio Amplifiers 工具用于评估:TAS5614L 工作电源电压:12 V to 38 V |
| CDB44800 | 功能描述:音频 IC 开发工具 Eval Bd 8-Ch 115dB 192kHz PWM RoHS:否 制造商:Texas Instruments 产品:Evaluation Kits 类型:Audio Amplifiers 工具用于评估:TAS5614L 工作电源电压:12 V to 38 V |
发布紧急采购，3分钟左右您将得到回复。