参数资料
| 型号： | CDC2509BPWG4 |
| 厂商： | Texas Instruments |
| 文件页数： | 13/14页 |
| 文件大小： | 0K |
| 描述： | IC PLL CLOCK DVR 3.3V 24-TSSOP |
| 标准包装： | 60 |
| 类型： | PLL 时钟驱动器 |
| PLL： | 带旁路 |
| 输入： | LVTTL |
| 输出： | LVTTL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:9 |
| 差分 - 输入:输出： | 无/无 |
| 频率 - 最大： | 125MHz |
| 除法器/乘法器： | 无/无 |
| 电源电压： | 3 V ~ 3.6 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 24-TSSOP（0.173"，4.40mm 宽） |
| 供应商设备封装： | 24-TSSOP |
| 包装： | 管件 |
CDC2509B
3.3V PHASELOCK LOOP CLOCK DRIVER
SCAS613C SEPTEMBER 1998 REVISED DECEMBER 2004
8
POST OFFICE BOX 655303
DALLAS, TEXAS 75265
TYPICAL CHARACTERISTICS
Figure 5
PHASE ERROR
vs
SUPPLY VOLTAGE
300
250
150
100
50
0
200
Phase
Error
ps
2.9
3.0
3.1
3.2
3.3
3.4
3.5
3.6
3.7
350
400
50
100
fc = 100 MHz
CLY = CLF = 30 pF
TA = 25°C
Phase Error Measured
from CLK to FBIN
VCC Supply Voltage V
Figure 6
JITTER
vs
CLOCK FREQUENCY
400
300
250
200
0
350
Jitter
ps
35
45
55
65
75
85
95
105 115 125
150
100
50
Cycle to Cycle
Peak to Peak
VCC = 3.3 V
TA = 25°C
fc Clock Frequency MHz
Figure 7
ANALOG SUPPLY CURRENT
vs
CLOCK FREQUENCY
12
10
6
4
2
0
8
10
20
40
60
80
100
120
140
14
16
AVCC = 3.6 V
Bias = 0/3 V
CLY = CLF = 30 pF
TA = 25°C
fc Clock Frequency MHz
AI
CC
Analog
Supply
Current
mA
Figure 8
0
50
100
150
200
250
20
40
60
80
100
120
140
SUPPLY CURRENT
vs
CLOCK FREQUENCY
fclk Clock Frequency MHz
VCC = 3.6 V
TA = 25°C
CLY = CLF = 30 pF
I CC
Supply
Current
mA
NOTES: A. CLY = Lumped capacitive load at Y
B. CLF = Lumped feedback capacitance at FBIN
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