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参数资料
| 型号： | CORE1553BRT-RM |
| 厂商： | Microsemi SoC |
| 文件页数： | 50/74页 |
| 文件大小： | 0K |
| 描述： | IP MODULE CORE1553 REMOTE TERM |
| 标准包装： | 1 |
| 系列： | * |
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Testbench Operation and Modification
required to transmit is 33 words. Receive data is strobed out of the module. All 1553B data words are put
out from this module.
The code below shows a simple code fragment that generates a 30-word BC–to–RT 1 subaddress 10
message with data incrementing from 4,096 decimal.
/************************************************************************/
// The Bus Controller Modules
//
QTBENCDEC BCA
(.CLK(CLK),
.RSTN(RSTN),
.BUSPOS(BUSAPOS),
.BUSNEG(BUSANEG),
.TXSTROBE(BCA_TXSTB),
.TXCW(BCA_TXCW),
.TXDATA(BCA_TXDATA),
.RXSTROBE(BCA_RXSTB),
.RXSTAT(BCA_RXSTAT),
.RXDATA(BCA_RXDATA),
.BUSY(BCA_BUSY)
);
/************************************************************************/
// Store the data put out by the decoder
//
// STAT[3:0] = FROMUS BURST ERROR CW
always @(posedge CLK)
begin
if (BCA_INIT==1'b1) BCA_COUNT = 0;
if (BCA_RXSTB == 1'b1)
begin
BCA_STORE[BCA_COUNT] = {BCA_RXSTAT, BCA_RXDATA };
BCA_COUNT = BCA_COUNT+1;
end
end
/************************************************************************/
// Main Test Procedure
//
reg [15:0] CW;
reg [15:0] DW;
reg [ 4:0] RT5BIT;
integer i;
integer RT;
initial
begin
RSTN = 1'b0;
BCA_TXSTB = 1'b0;
BCB_TXSTB = 1'b0;
BCA_INIT = 1'b1;
// Used to load a word into the transmitter
// Used to reset the store pointer on the Decoder
BCB_INIT = 1'b1;
#312700;
@(negedge CLK);
RSTN = 1'b1;
$display("Core1553BRT Verilog Test Harness Production 19Jan09");
$display("Receive BC-RT 1 SA 10 WC 8 Message on BUS A");
CW = { 5'b00001, 1'b0, 5'b01010, 5'b01000 };
transmit_CW(0,CW);
for ( i=1; i<=8; i=i+1) transmit_DW(0,4095+i);
Revision 3
50
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