参数资料
| 型号： | CS53L21-CNZR |
| 厂商： | Cirrus Logic Inc |
| 文件页数： | 7/26页 |
| 文件大小： | 0K |
| 描述： | IC ADC STEREO 24BIT 98DB 32-QFN |
| 标准包装： | 6,000 |
| 位数： | 24 |
| 采样率（每秒）： | 100k |
| 数据接口： | 串行 |
| 转换器数目： | 2 |
| 功率耗散（最大）： | 30mW |
| 电压电源： | 模拟和数字 |
| 工作温度： | -10°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 32-QFN |
| 供应商设备封装： | 32-QFN（5x5） |
| 包装： | 带卷 (TR) |
| 输入数目和类型： | 3 个单端，单极 |
| 配用： | 598-1550-ND - BOARD EVAL FOR CS53L21 ADC |
DS700PP1
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CS53L21
7. After powering up the CS53L21, RESET should be held low after the power supplies and clocks are
settled.
8. See “Example System Clock Frequencies” on page 57 for typical MCLK frequencies.
9. See“Master” on page 30.
10. “MCLK” refers to the external master clock applied.
Master Mode (Note 9)
Output Sample Rate (LRCK)
All Speed Modes
Fs
-Hz
LRCK Duty Cycle
45
55
%
SCLK Frequency
1/tP
-
64Fs
Hz
SCLK Duty Cycle
45
55
%
LRCK Edge to SDOUT MSB Output Delay
td(MSB)
-52
ns
SDOUT Setup Time Before SCLK Rising Edge
ts(SDO-SK)
20
-
ns
SDOUT Hold Time After SCLK Rising Edge
th(SK-SDO)
30
-
ns
Parameters
Symbol
Min
Max
Units
MCLK
128
-----------------
th(SK-SDO)
//
MSB
MSB-1
LRCK
SCLK
SDOUT
td(MSB)
ts(LK-SK)
tP
ts(SDO-SK)
Figure 3. Serial Audio Interface Slave Mode Timing
th(SK-SDO)
//
MSB
MSB-1
LRCK
SCLK
SDOUT
td(MSB)
tP
ts(SDO-SK)
Figure 4. Serial Audio Interface Master Mode Timing
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PDF描述 |
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参数描述 |
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| CS53L30-CWZR | 功能描述:音频模/数转换器 IC 4 Mic ADC RoHS:否 制造商:Wolfson Microelectronics 转换速率: 分辨率: ADC 输入端数量: 工作电源电压: 最大工作温度: 最小工作温度: 安装风格: 封装 / 箱体: 封装: |
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