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参数资料
| 型号： | CY39050Z484-222MBC |
| 厂商： | CYPRESS SEMICONDUCTOR CORP |
| 元件分类： | PLD |
| 英文描述： | LOADABLE PLD, 7 ns, PBGA484 |
| 封装： | 23 X 23 MM, 1.60 MM HEIGHT, 1 MM PITCH, TFBGA-484 |
| 文件页数： | 12/57页 |
| 文件大小： | 1166K |
| 代理商： | CY39050Z484-222MBC |
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PRELIMINARY
Delta39K ISR
CPLD Family
Document #: 38-03039 Rev. **
Page 2 of 57
Delta39K Speed Bins[3]
Device
250
222
200
181
167
154
125
83
39K15
X
XX
39K30
X
39K50
X
39K100
X
39K165
X
39K200
X
39K250
X
39K350
XXX
Device Package Offering and I/O Count Including Dedicated Clock and Control Inputs
Device
208-EQFP
28X28 mm
0.5-mm
pitch
144-FBGA
13x13 mm
1.0-mm
pitch
256-FBGA
17x17 mm
1.0-mm
pitch
484-FBGA
23x23 mm
1.0-mm
pitch
676-FBGA
27x27 mm
1.0-mm
pitch
Self-Boot Solution[4]
256-FBGA
17x17 mm
1.0-mm
pitch
388-BGA
35x35 mm
1.27-mm
pitch
484-FBGA
23x23 mm
1.0-mm pitch
676-FBGA
27x27 mm
1.0-mm
pitch
39K15
134
92
134
39K30
136
92
176
39K50
136
180
218
39K100
136
180
302
294
302
39K165
136
356
294
386
39K200
136
368
294
428
39K250
136
470
294
470
39K350
136
520
294
520
Notes:
3.
Speed bins shown here are for Commercial operating range. Please refer to Delta39K Ordering Information on page 41 for Industrial range speed bins.
4.
Self-Boot Solution integrates the boot PROM (Flash Memory) with Delta39K die inside the same package.
相关PDF资料 |
PDF描述 |
|---|---|
| CY39200V208-167NTC | LOADABLE PLD, 8.5 ns, PQFP208 |
| CY39200V388-167MGC | LOADABLE PLD, 8.5 ns, PBGA388 |
| CY39200V484-167BBC | LOADABLE PLD, 8.5 ns, PBGA484 |
| CY39200V676-167MBC | LOADABLE PLD, 8.5 ns, PBGA676 |
| CY39200Z208-167NC | LOADABLE PLD, 8.5 ns, PQFP208 |
相关代理商/技术参数 |
参数描述 |
|---|---|
| CY39050Z676-125BBC | 制造商:CYPRESS 制造商全称:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY39050Z676-125BBI | 制造商:CYPRESS 制造商全称:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY39050Z676-125BGC | 制造商:CYPRESS 制造商全称:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY39050Z676-125BGI | 制造商:CYPRESS 制造商全称:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY39100V208-125BBC | 制造商:CYPRESS 制造商全称:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
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