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参数资料
| 型号： | CY39200V388-200NTC |
| 厂商： | Cypress Semiconductor Corp. |
| 英文描述： | CPLDs at FPGA Densities |
| 中文描述： | CPLD器件在FPGA的密度 |
| 文件页数： | 30/86页 |
| 文件大小： | 1235K |
| 代理商： | CY39200V388-200NTC |
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Delta39K ISR
CPLD Family
Document #: 38-03039 Rev. *H
Page 30 of 86
Switching Waveforms
(continued)
Channel Memory DP Asynchronous Timing
WRITE
ENABLE
t
CHMPWE
t
CHMSA
t
CHMHA
t
CHMAA
t
CHMHD
ADDRESS
DATA
INPUT
OUTPUT
t
CHMAA
A
n-1
A
n
A
n+1
A
n+2
D
n
D
n–1
D
n
D
n+1
t
CHMSD
Channel Memory Internal Clocking
CLOCK
INPUT CLOCK
OUTPUT CLOCK
t
CHMMACS1
t
MACCHMS2
t
CHMMACS2
t
MACCHMS1
MACROCELL INPUT
CHANNEL MEMORY
CHANNEL MEMORY
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PDF描述 |
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