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参数资料
| 型号： | DK-MAXII-1270N |
| 厂商： | Altera |
| 文件页数： | 18/38页 |
| 文件大小： | 0K |
| 描述： | KIT DEV MAXII W/EPM 1270N |
| 产品培训模块： | Three Reasons to Use FPGA's in Industrial Designs |
| 特色产品： | MAX? II CPLD Development Kit |
| 标准包装： | 1 |
| 系列： | MAX® II |
| 类型： | CPLD |
| 适用于相关产品： | MAX?II CPLD |
| 所含物品： | 开发板、Quartus?II 网络版、Nios?II 网络版、缆线、附件、参考设计和演示 |
| 产品目录页面： | 605 (CN2011-ZH PDF) |
| 相关产品： | 544-2266-ND - IC MAX II CPLD 1270 LE 256-FBGA 544-2265-ND - IC MAX II CPLD 1270 LE 256-FBGA 544-1732-ND - IC MAX II CPLD 1270 LE 256-MBGA 544-1723-ND - IC MAX II CPLD 1270 LE 256-MBGA 544-1722-ND - IC MAX II CPLD 1270 LE 256-MBGA 544-1721-ND - IC MAX II CPLD 1270 LE 256-MBGA 544-1675-ND - IC MAX II CPLD 1270 LE 256-FBGA 544-1652-ND - IC MAX II CPLD 1270 LE 144-TQFP 544-1388-ND - IC MAX II CPLD 1270 LE 144-TQFP 544-1387-ND - IC MAX II CPLD 1270 LE 144-TQFP 更多... |
| 其它名称： | 544-2380 |
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Demo Designs
configured. Press S2 and the 000 changes to the number of times that
the MAX II device could have configured itself in that interval
(typical values should be between 300-600 for fast button pushers).
Test 2. Using a Scope to Measure Power-Up Times
1.
2.
3.
4.
5.
Program the MAX II device with the InstantOnDemo.pof file that is
located in the <root> /Examples/HW/Demos directory. (Refer to
to load POF files into the MAX II device.)
Attach scope probes to the four Active I/O test points located near
the prototyping area on the board.
Set the trigger on the scope to the channel connected to the V CCINT
test point and trigger on the rising edge (LVTTL logic level).
Set the load on V CCINT to the desired amount by tuning the variable
resistor (potentiometer), labeled POT1.
Press S5 on the board to interrupt the power and observe the ramp
time of V CCINT via the provided test point. A sample screen is shown
below (see Figure 2–4 ).
Understanding the Results
The most detailed analysis of the power-up character of a MAX II device
comes from viewing probe points during the power-up cycle with a
digital oscilloscope. The development board has a variable core V CC rise
time control. This system uses POT1 to vary the MAX II core V CC rise time
from 80 μ s to 150 ms. The on-board test points provide users with an easy
way to examine the ramp time of V CCINT and the resulting configuration
completion time. The ramp time of V CCINT can be varied with POT1, thus
allowing this circuit to match almost any system’s power-up rise time and
analyze how the MAX II device performs. To make power cycling even
easier, S5 will power cycle the MAX II V CCINT supply any time it is
pressed and released. The development board provides four useful probe
points:
■
■
■
■
V_INT = V CCINT (MAX II core voltage supply)
V_IO = V CCIO (MAX II I/O voltage supply)
GND = Board Ground plane
ACTIVE_IO = MAX II User I/O pin P12
2–10 Development Kit Version 1.1.0
MAX II Development Kit Getting Started User Guide
Altera Corporation
July 2005
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