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参数资料
| 型号： | DS2181A+ |
| 厂商： | Maxim Integrated Products |
| 文件页数： | 21/32页 |
| 文件大小： | 0K |
| 描述： | IC TXRX CEPT PRIMARY RATE 40-DIP |
| 产品培训模块： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 标准包装： | 10 |
| 类型： | 收发器 |
| 驱动器/接收器数： | 1/1 |
| 规程： | CEPT |
| 电源电压： | 4.5 V ~ 5.5 V |
| 安装类型： | 通孔 |
| 封装/外壳： | 40-DIP（0.600"，15.24mm） |
| 供应商设备封装： | 40-PDIP |
| 包装： | 管件 |
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DS2181A
28 of 32
AC ELECTRICAL CHARACTERISTICS
1,2 SERIAL PORT
(0
°C to 70°C; V
DD = 5.0V ± 5%)
PARAMETER
SYMBOL
MIN
TYP
MAX
UNITS
NOTES
SDI to SCLK Setup
tDC
50
ns
SCLK to SDI Hold
tCDH
50
ns
SCLK Low Time
tCL
244
ns
SCLK High Time
tCH
244
ns
SCLK Rise and Fall Time
tR, tF
100
ns
CS
to SCLK Setup
tCC
50
ns
SCLK to CS Hold
tCCH
50
ns
CS
Inactive Time
tCWH
2.5
ns
SLK to SDO Valid
tCDV
200
ns
CS
to SDO High Z
tCDZ
75
ns
NOTES:
1. Measured at VIH =2.0 V; VIL =.8 V and 10 ns maximum rise and fall time.
2. Output load capacitance = 100 pF.
AC ELECTRICAL CHARACTERISTICS
1,2 – TRANSMIT
(0
°C to 70°C; V
DD = 5.0V ± 5%)
PARAMETER
SYMBOL
MIN
TYP
MAX
UNITS
NOTES
TCLK Period
tP
488
ns
TCLK Pulse Width
tWL, tWH
244
ns
TCLK Raise & Fall Time
tW, tR
20
ns
TSER, TSD, TIND and TXD
Setup to TCLK Falling
tSTD
50
ns
TSER, TSD, TIND and TXD
Hold to TCLK Falling
tHTD
50
ns
TFSYNC, TMSYNC Setup to
TCLK Falling
tSTS
75
ns
TFSYNC, TMSYNC Hold to
TCLK Falling
tHTS
50
ns
Propagation Delay TCLK to
TCHCLK, TSTS, TMO, TAF
tPTS
75
ns
NOTES:
1. Measured at VIH = 2.0V; VIL = .8V and 10 ns maximum rise and fall time.
2. Output load capacitance = 100 pF.
相关PDF资料 |
PDF描述 |
|---|---|
| MC10EP16TDTG | IC RCVR/DRVR ECL DIFF 5V 8TSSOP |
| DS2181A | IC TXRX CEPT PRIMARY RATE 40-DIP |
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| MC10E116FNG | IC LINE RCVR QUINT ECL 5V 28PLCC |
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相关代理商/技术参数 |
参数描述 |
|---|---|
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| DS2181AQ | 功能描述:网络控制器与处理器 IC RoHS:否 制造商:Micrel 产品:Controller Area Network (CAN) 收发器数量: 数据速率: 电源电流（最大值）:595 mA 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:PBGA-400 封装:Tray |
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