参数资料
型号: DS21FF42
厂商: Maxim Integrated Products
文件页数: 112/114页
文件大小: 0K
描述: IC FRAMER T1 4X4 16CH 300-BGA
产品培训模块: Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
标准包装: 40
控制器类型: T1 调帧器
接口: 并行/串行
电源电压: 2.97 V ~ 3.63 V
电流 - 电源: 300mA
工作温度: 0°C ~ 70°C
安装类型: 表面贴装
封装/外壳: 300-BBGA
供应商设备封装: 300-PBGA(27x27)
包装: 管件
DS21FT42/DS21FF42
97 of 114
RECEIVE SIDE INTERLEAVED BUS OPERATION FRAME MODE TIMING
Figure 23-7
TRANSMIT SIDE D4 TIMING Figure 23-8
FRAME#
12
3
4
5
6
7
8
9
10
11
12
1
23
45
1
2
3
4
TSYNC
TLCLK
TLINK
Notes:
1. TSYNC in the frame mode (TCR2.3 = 0) and double-wide frame sync is not enabled (TCR2.4 = 0)
2. TSYNC in the frame mode (TCR2.3 = 0) and double-wide frame sync is enabled (TCR2.4 = 1)
3. TSYNC in the multiframe mode (TCR2.3 = 1)
4. TLINK data (Fs - bits) is sampled during the F-bit position of even frames for insertion into the
outgoing T1 streamwhen enabled via TCR1.2
5. TLINK and TLCLK are not synchronous with TFSYNC
SS
g
RSER
LSB
SYSCLK
RSYNC
FRAMER 3, CHANNEL 32
MSB
LSB
FRAMER 0, CHANNEL 1
RSIG
D/B
C/D
B
A
C/A
B
FRAMER 3, CHANNEL 32
A
FRAMER 0, CHANNEL 1
MSB
LSB
FRAMER 0, CHANNEL 2
D/B
C/D
B
A
FRAMER 0, CHANNEL 2
Notes:
1. 4.096 MHz bus configuration.
2. 8.192 MHz bus configuration.
3. RSYNC is in the input mode (RCR2.3 = 1).
3
RSER
RSYNC
RSIG
FR1 CH1-32
FR0 CH1-32
FR1 CH1-32
RSER
RSIG
FR2 CH1-32 FR3 CH1-32 FR0 CH1-32 FR1 CH1-32 FR2 CH1-32 FR3 CH1-32 FR0 CH1-32 FR1 CH1-32 FR2 CH1-32 FR3 CH1-32
FR0 CH1-32
FR1 CH1-32
FR0 CH1-32
FR1 CH1-32
FR0 CH1-32
FR1 CH1-32
1
2
BIT DETAIL
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