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参数资料
| 型号： | DS21FT40 |
| 厂商： | DALLAS SEMICONDUCTOR |
| 元件分类： | Digital Transmission Controller |
| 英文描述： | DATACOM, FRAMER, PBGA300 |
| 封装： | BGA-300 |
| 文件页数： | 84/87页 |
| 文件大小： | 386K |
| 代理商： | DS21FT40 |
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DS21FT40
85 of 87
TRANSMIT SIDE AC TIMING Figure 17-11
t
F
t
R
1
TC L K
T SER
t
CL
t
CH
CP
TS Y N C
t D2
t
SU
HD
t HD
2
Notes:
1. TSYNC is in the output mode (TCR1.0 = 1).
2. TSYNC is in the input mode (TCR1.0 = 0).
3. TSER is sampled on the falling edge of TCLK when the transmit side elastic store is disabled.
t SU
TRANSMIT SYSTEM SIDE AC TIMING Figure 17-12
t
F
t
R
T SYSCL K
T SER
t
SL
t
SH
SP
T SSYN C
t
t SU
HD
SU
Notes:
1. TSER is only sampled on the falling edge of TSYSCLK when the transmit side elastic store is enabled.
TRANSMIT LINE INTERFACE SIDE AC TIMING Figure 17-13
t
F
t
R
TCLK
TPOS, TNEG
t
CL
t
CH
CP
tDD
相关PDF资料 |
PDF描述 |
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