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参数资料
| 型号： | DS26401N+ |
| 厂商： | Maxim Integrated Products |
| 文件页数： | 101/309页 |
| 文件大小： | 0K |
| 描述： | IC OCTAL FRAMER T1/E1/J1 256-BGA |
| 产品培训模块： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 标准包装： | 90 |
| 控制器类型： | T1/E1/J1 调帧器 |
| 接口： | WAN |
| 电源电压： | 3.135 V ~ 3.465 V |
| 电流 - 电源： | 275mA |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 256-LBGA，CSBGA |
| 供应商设备封装： | 256-CSBGA（17x17） |
| 包装： | 托盘 |
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DS26401 Octal T1/E1/J1 Framer
19
5.2 Transmit Framer Signals
Signal Name:
TPOS (1–8)
Signal Description:
Transmit Positive Data Output
Signal Type:
Output
Update on the rising edge of TCLK with the bipolar data out of the transmit side formatter. Can be programmed to
source NRZ data via the output data format (TCR3.7) control bit.
Signal Name:
TNEG (1–8)
Signal Description:
Transmit Negative Data Output
Signal Type:
Output
Update on the rising edge of TCLK with the bipolar data out of the transmit side formatter.
Signal Name:
TCLK (1–8)
Signal Description:
Transmit Clock
Signal Type:
Input
A 1.544MHz or a 2.048MHz primary clock. Used to clock data through the transmit side formatter.
Signal Name:
TCLKO (1–8)
Signal Description:
Transmit Clock Output
Signal Type:
Output
This clock is provided to simplify interface to a line interface unit (LIU). This signal is used to register the TPOS and
TNEG outputs and is typically synchronous with the TCLK input. However, in framer and payload loopback
applications this signal becomes synchronous with RCLK.
Signal Name:
TSER (1–8)
Signal Description:
Transmit Serial Data
Signal Type:
Input
Transmit NRZ serial data. Sampled on the falling edge of TCLK when the transmit-side elastic store is disabled.
Sampled on the falling edge of TSYSCLK when the transmit side elastic store is enabled.
Signal Name:
TSIG (1–8)
Signal Description:
Transmit Signaling Input
Signal Type:
Input
When enabled, this input will sample signaling bits for insertion into outgoing PCM data stream. Sampled on the
falling edge of TCLK when the transmit-side elastic store is disabled. Sampled on the falling edge of TSYSCLK
when the transmit-side elastic store is enabled.
Signal Name:
TSYNC (1–8)
Signal Description:
Transmit Sync
Signal Type:
Input / Output
A pulse at this pin will establish either frame or multiframe boundaries for the transmit side. This signal can also be
programmed to output either a frame or multiframe pulse. If this pin is set to output pulses at frame boundaries, it
can also be set to output doublewide pulses at signaling frames in T1 mode.
Signal Name:
TSSYNC (1–8)
Signal Description:
Transmit System Sync
Signal Type:
Input
Only used when the transmit-side elastic store is enabled. A pulse at this pin will establish either frame or
multiframe boundaries for the transmit side. Should be tied low in applications that do not use the transmit-side
elastic store.
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| DS26502_06 | 制造商:DALLAS 制造商全称:Dallas Semiconductor 功能描述:T1/E1/J1/64KCC BITS Element |
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