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参数资料
型号： DS31256
厂商： Maxim Integrated Products
文件页数： 106/183页
文件大小： 0K
描述： IC CTRLR HDLC 256-CHANNEL 256BGA
产品培训模块： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
标准包装： 40
控制器类型： HDLC 控制器
接口： 串行
电源电压： 3 V ~ 3.6 V
电流 - 电源： 500mA
工作温度： 0°C ~ 70°C
安装类型： 表面贴装
封装/外壳： 256-BBGA
供应商设备封装： 256-BGA（27x27）
包装： 管件
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DS31256 256-Channel, High-Throughput HDLC Controller
29 of 183
4.6 HDLC Registers (4xx)
OFFSET/
ADDRESS
NAME
REGISTER
SECTION
0400
RHCDIS
Receive HDLC Channel Definition Indirect Select
7.2
0404
RHCD
Receive HDLC Channel Definition
7.2
0410
RHPL
Receive HDLC maximum Packet Length. One per device.
7.2
0480
THCDIS
Transmit HDLC Channel Definition Indirect Select
7.2
0484
THCD
Transmit HDLC Channel Definition
7.2
4.7 BERT Registers (5xx)
OFFSET/
ADDRESS
NAME
REGISTER
SECTION
0500
BERTC0
BERT Control 0
6.6
0504
BERTC1
BERT Control 1
6.6
0508
BERTRP0
BERT Repetitive Pattern Set 0 (lower word)
6.6
050C
BERTRP1
BERT Repetitive Pattern Set 1 (upper word)
6.6
0510
BERTBC0
BERT Bit Counter 0 (lower word)
6.6
0514
BERTBC1
BERT Bit Counter 1 (upper word)
6.6
0518
BERTEC0
BERT Error Counter 0 (lower word)
6.6
051C
BERTEC1
BERT Error Counter 1 (upper word)
6.6
4.8 Receive DMA Registers (7xx)
OFFSET/
ADDRESS
NAME
REGISTER
SECTION
0700
RFQBA0
Receive Free-Queue Base Address 0 (lower word)
9.2.3
0704
RFQBA1
Receive Free-Queue Base Address 1 (upper word)
9.2.3
0708
RFQEA
Receive Free-Queue End Address
9.2.3
070C
RFQSBSA
Receive Free-Queue Small Buffer Start Address
9.2.3
0710
RFQLBWP
Receive Free-Queue Large Buffer Host Write Pointer
9.2.3
0714
RFQSBWP
Receive Free-Queue Small Buffer Host Write Pointer
9.2.3
0718
RFQLBRP
Receive Free-Queue Large Buffer DMA Read Pointer
9.2.3
071C
RFQSBRP
Receive Free-Queue Small Buffer DMA Read Pointer
9.2.3
0730
RDQBA0
Receive Done-Queue Base Address 0 (lower word)
9.2.4
0734
RDQBA1
Receive Done-Queue Base Address 1 (upper word)
9.2.4
0738
RDQEA
Receive Done-Queue End Address
9.2.4
073C
RDQRP
Receive Done-Queue Host Read Pointer
9.2.4
0740
RDQWP
Receive Done-Queue DMA Write Pointer
9.2.4
0744
RDQFFT
Receive Done-Queue FIFO Flush Timer
9.2.4
0750
RDBA0
Receive Descriptor Base Address 0 (lower word)
9.2.2
0754
RDBA1
Receive Descriptor Base Address 1 (upper word)
9.2.2
0770
RDMACIS
Receive DMA Configuration Indirect Select
9.3.5
0774
RDMAC
Receive DMA Configuration
9.3.5
0780
RDMAQ
Receive DMA Queues Control
9.2.3/9.2.4
0790
RLBS
Receive Large Buffer Size
9.2.1
0794
RSBS
Receive Small Buffer Size
9.2.1
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