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参数资料
| 型号： | DS72612RP80FPV |
| 厂商： | Renesas Electronics America |
| 文件页数： | 167/226页 |
| 文件大小： | 0K |
| 描述： | IC SUPERH MPU ROMLESS 176LQFP |
| 产品培训模块： | CAN Basics Part-1 CAN Basics Part-2 Electromagnetic Noise Reduction Techniques Part 1 |
| 标准包装： | 1 |
| 系列： | SuperH® SH7200 |
| 核心处理器： | SH-2A |
| 芯体尺寸： | 32-位 |
| 速度： | 80MHz |
| 连通性： | EBI/EMI，FIFO，I²C，IEBus，SCI，串行声控 |
| 外围设备： | DMA，POR，PWM，WDT |
| 输入/输出数： | 104 |
| 程序存储器类型： | ROMless |
| RAM 容量： | 32K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 3 V ~ 3.6 V |
| 数据转换器： | A/D 8x10b; D/A 2x8b |
| 振荡器型： | 外部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 176-LQFP |
| 包装： | 托盘 |
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R01UH0025EJ0300 Rev. 3.00
Page xxvii of xxxii
Sep 24, 2010
21.3.43
Automatic Buffering Start Sector Setting: Seconds Control Register
(CBUFCTL2).................................................................................................... 984
21.3.44
Automatic Buffering Start Sector Setting: Frames Control Register
(CBUFCTL3).................................................................................................... 984
21.3.45
ISY Interrupt Source Mask Control Register (CROMST0M) .......................... 985
21.3.46
CD-ROM Decoder Reset Control Register (ROMDECRST) ........................... 986
21.3.47
CD-ROM Decoder Reset Status Register (RSTSTAT) .................................... 987
21.3.48
SSI Data Control Register (SSI) ....................................................................... 987
21.3.49
Interrupt Flag Register (INTHOLD)................................................................. 990
21.3.50
Interrupt Source Mask Control Register (INHINT) .......................................... 991
21.3.51
Buffer Control Register (RINGBUFCTL) ........................................................ 992
21.3.52
CD-ROM Decoder Stream Data Input Register (STRMDIN0) ........................ 993
21.3.53
CD-ROM Decoder Stream Data Input Register (STRMDIN1) ........................ 993
21.3.54
CD-ROM Decoder Stream Data Input Register (STRMDIN2) ........................ 994
21.3.55
CD-ROM Decoder Stream Data Input Register (STRMDIN3) ........................ 994
21.3.56
CD-ROM Decoder Stream Data Output Register (STRMDOUT0).................. 995
21.3.57
CD-ROM Decoder Stream Data Output Register (STRMDOUT1).................. 995
21.4
Operation .......................................................................................................................... 996
21.4.1
Endian Conversion for Data in the Input Stream .............................................. 996
21.4.2
Sync Code Maintenance Function .................................................................... 997
21.4.3
Error Correction .............................................................................................. 1002
21.4.4
Automatic Decoding Stop Function................................................................ 1003
21.4.5
Buffering Format ............................................................................................ 1004
21.4.6
Target-Sector Buffering Function ................................................................... 1006
21.5
Interrupt Sources............................................................................................................. 1008
21.5.1
Interrupt and DMA Transfer Request Signals................................................. 1008
21.5.2
Timing of Status Registers Updates................................................................ 1010
21.6
Usage Notes .................................................................................................................... 1010
21.6.1
Stopping and Resuming Buffering Alone During Decoding .......................... 1010
21.6.2
When CROMST0 Status Register Bits are Set ............................................... 1010
21.6.3
Link Blocks..................................................................................................... 1010
21.6.4
Reading from the STRMDOUT0 and STRMDOUT1 Registers .................... 1011
21.6.5
Stopping and Resuming CD-DSP Operation .................................................. 1012
Section 22 A/D Converter (ADC)....................................................................1013
22.1
Features........................................................................................................................... 1013
22.2
Input/Output Pins ............................................................................................................ 1015
22.3
Register Configuration.................................................................................................... 1016
22.3.1
A/D Data Registers A to H (ADDRA to ADDRH) ........................................ 1016
22.3.2
A/D Control/Status Register (ADCSR) .......................................................... 1018
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