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参数资料
| 型号： | DSPB56724AG |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 7/48页 |
| 文件大小： | 0K |
| 描述： | DSP 24BIT AUD 250MHZ 144-LQFP |
| 标准包装： | 60 |
| 系列： | DSP56K/Symphony |
| 类型： | 音频处理器 |
| 接口： | 主机接口，I²C，SAI，SPI |
| 时钟速率： | 250MHz |
| 非易失内存： | 外部 |
| 芯片上RAM： | 112kB |
| 电压 - 输入/输出： | 3.30V |
| 电压 - 核心： | 1.20V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 144-LQFP |
| 供应商设备封装： | 144-LQFP（20x20） |
| 包装： | 托盘 |
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Symphony DSP56724/ DSP56725 Multi-Core Audio Processors, Rev. 2
Freescale Semiconductor
15
1.2.1
Serial Host Interface SPI Protocol Timing
Table 9 lists the serial host interface SPI protocol timing.
Table 9. Serial Host Interface SPI Protocol Timing
No.
Characteristics1,3,4
Mode
Filter Mode
Expression
Min
Max
Unit
23
Minimum serial clock cycle = tSPICC(min)
Master/Slave
Bypassed
10
× TC + 9
59.0
—
ns
Very Narrow
10
× TC + 9
59.0
—
ns
Narrow
10
× TC + 133
183.0
—
ns
Wide
10
× TC + 333
383.0
—
ns
XX
Tolerable Spike width on data or clock in.
—
Bypassed
—
0
ns
Very Narrow
—
10
ns
Narrow
—
50
ns
Wide
—
100
ns
24
Serial clock high period
Master
Bypassed
0.5
× (tSPICC)
29.5
—
ns
Very Narrow
0.5
× (tSPICC)
29.5
—
ns
Narrow
0.5
× (tSPICC)
91.5
—
ns
Wide
0.5
× (tSPICC)
191.5
—
ns
Slave
Bypassed
2.0
× TC + 19.6
29.6
—
ns
Very Narrow
2.0
× TC + 19.6
29.6
—
ns
Narrow
2.0
× TC + 86.6
96.6
—
ns
Wide
2.0
× TC + 186.6
196.6
—
ns
25
Serial clock low period
Master
Bypassed
0.5
× (tSPICC)
29.5
—
ns
Very Narrow
0.5
× (tSPICC)
29.5
—
ns
Narrow
0.5
× (tSPICC)
91.5
—
ns
Wide
0.5
× tSPICC)
191.5
—
ns
Slave
Bypassed
2.0
× TC + 19.6
29.6
—
ns
Very Narrow
2.0
× TC + 19.6
29.6
—
ns
Narrow
2.0
× TC + 86.6
96.6
—
ns
Wide
2.0
× TC + 186.6
196.6
—
ns
26
Serial clock rise/fall time
Master
Slave
—
5
ns
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