参数资料
型号: DSPIC30F3011-30I/P
厂商: Microchip Technology
文件页数: 21/228页
文件大小: 0K
描述: IC DSPIC MCU/DSP 24K 40DIP
产品培训模块: dsPIC30F Quadrature Encoder Interface
Serial Communications using dsPIC30F I2C
Serial Communications using dsPIC30F SPI
Serial Communications using dsPIC30F UART
dsPIC30F 12 bit ADC - Part 2
dsPIC30F Addressing Modes - Part 1
dsPIC30F Architecture - Part 1
dsPIC30F DSP Engine & ALU
dsPIC30F Interrupts
dsPIC30F Motor Control PWM
dsPIC Timers
Asynchronous Stimulus
dsPIC30F Addressing Modes - Part 2
dsPIC30F Architecture - Part 2
dsPIC30F 12-bit ADC Part 1
标准包装: 10
系列: dsPIC™ 30F
核心处理器: dsPIC
芯体尺寸: 16-位
速度: 30 MIP
连通性: I²C,SPI,UART/USART
外围设备: 高级欠压探测/复位,电机控制 PWM,QEI,POR,PWM,WDT
输入/输出数: 30
程序存储器容量: 24KB(8K x 24)
程序存储器类型: 闪存
EEPROM 大小: 1K x 8
RAM 容量: 1K x 8
电压 - 电源 (Vcc/Vdd): 2.5 V ~ 5.5 V
数据转换器: A/D 9x10b
振荡器型: 内部
工作温度: -40°C ~ 85°C
封装/外壳: 40-DIP(0.600",15.24mm)
包装: 管件
产品目录页面: 651 (CN2011-ZH PDF)
配用: AC30F003-ND - MODULE SOCKET DSPIC30F 40DIP
DV164005-ND - KIT ICD2 SIMPLE SUIT W/USB CABLE
ACICE0206-ND - ADAPTER MPLABICE 40P 600 MIL
其它名称: DSPIC30F3011-30IP
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117
XMEGA A [MANUAL]
8077I–AVR–11/2012
10.6
Register Description
10.6.1 CTRL: Control register
Bit 7: 6 – Reserved
These bits are unused and reserved for future use. For compatibility with future devices, always write this bit to zero
when this register is written.
Bit 5 – HIGHESR: High ESR Mode
Setting this bit will increase the current used to drive the crystal and increase the swing on the TOSC2 pin. This allows
use of crystals with higher load and higher ESR.
Bit 4 – XOSCSEL: Crystal Oscillator Output Selection
This bit selects the prescaled clock output from the 32.768kHz crystal oscillator. After reset, this bit is zero, and the 1Hz
clock output is used as input for the RTC. Setting this bit will select the 1.024kHz clock output as input for the RTC32.
This bit cannot be changed when XOSCEN is set.
Bit 3 – XOSCEN: Crystal Oscillator Enable
Setting this bit will enable the 32.768kHz crystal oscillator. Writing the bit to zero will have no effect, and the oscillator will
remain enabled until a battery backup reset is issued. The Crystal oscillator can also be used as 32.768 kHz system
clock after performing step one to three described in “Configuration” on page 116.
Bit 2 – XOSCFDEN: Crystal Oscillator Failure Detection Enable
Setting this bit will enable the crystal oscillator monitor. The monitor will detect if the crystal is stopped or loses
connection temporarily. At least 64 swings must be lost before the failure detection is triggered. Writing the bit to zero will
have no effect, and the crystal oscillator monitor will remain enabled until a battery backup reset is issued.
Bit 1 – ACCEN: Module Access Enable
Setting this bit will enable access to the battery backup registers. After main reset, this bit must be set in order to access
(read from and write to) the battery backup registers, except for the BBPODF, the BBBODF, and the BBPWR flags,
which are always accessible. Writing this bit to zero will have no effect; only a device reset will clear this bit.
Bit 0 – RESET: Reset
Setting this bit will force a reset of the battery backup system lasting one peripheral clock cycle. Writing the bit to zero will
have no effect. Writing a one to XOSCEN or XOSCFDEN at the same time will block writing to this bit. When this bit is
set, HIGHESR, XOSCSEL, XOSCEN, and XOSCFDEN in CTRL and XOSCRDY in STATUS will be cleared.
This bit is protected by the Configuration Change Protection mechanism. For a detailed description, refer to
Bit
7
6
5
4
3
2
1
0
+0x00
HIGHESR
XOSCSEL
XOSCEN
XOSCFDEN
ACCEN
RESET
Read/Write
R
R/W
initial Value
0
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PDF描述
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