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参数资料
| 型号： | EFM32-TG-STK3300 |
| 厂商： | Energy Micro |
| 文件页数： | 115/136页 |
| 文件大小： | 0K |
| 描述： | KIT STARTER EFM32 GECKO |
| 特色产品： | EFM32 Tiny Gecko |
| 标准包装： | 1 |
| 系列： | EFM®32 |
| 类型： | MCU |
| 适用于相关产品： | EFM32-TGXXX |
| 所含物品： | 板，线缆，CD 和文档 |
| 其它名称： | 914-1018 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页当前第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页
...the world's most energy friendly microcontrollers
2011-02-04 - d0002_Rev1.00
8
www.energymicro.com
Name
Type
1
Required
privilege
2
Reset value
Description
PRIMASK
RW
Privileged
0x00000000
FAULTMASK
RW
Privileged
0x00000000
BASEPRI
RW
Privileged
0x00000000
CONTROL
RW
Privileged
0x00000000
1Describes access type during program execution in thread mode and Handler mode. Debug access can differ.
2An entry of Either means privileged and unprivileged software can access the register.
2.1.3.1 General-purpose registers
R0-R12 are 32-bit general-purpose registers for data operations.
2.1.3.2 Stack Pointer
The Stack Pointer (SP) is register R13. In Thread mode, bit[1] of the CONTROL register indicates the
stack pointer to use:
0 = Main Stack Pointer (MSP). This is the reset value.
1 = Process Stack Pointer (PSP).
On reset, the processor loads the MSP with the value from address 0x00000000.
2.1.3.3 Link Register
The Link Register (LR) is register R14. It stores the return information for subroutines, function calls,
and exceptions. On reset, the processor loads the LR value 0xFFFFFFFF.
2.1.3.4 Program Counter
The Program Counter (PC) is register R15. It contains the current program address. Bit[0] is always 0
because instruction fetches must be halfword aligned. On reset, the processor loads the PC with the
value of the reset vector, which is at address 0x00000004.
2.1.3.5 Program Status Register
The Program Status Register (PSR) combines:
Application Program Status Register (APSR)
Interrupt Program Status Register (IPSR)
Execution Program Status Register (EPSR).
These registers are mutually exclusive bitfields in the 32-bit PSR. The bit assignments are:
25 24 23
Reserved
ISR_NUMBER
31 30 29 28 27
N Z C V
0
Reserved
APSR
IPSR
EPSR
Reserved
26
16 15
10 9
Reserved
ICI/IT
T
Q
8
The PSR bit assignments are:
相关PDF资料 |
PDF描述 |
|---|---|
| HSC08DRYH-S13 | CONN EDGECARD 16POS .100 EXTEND |
| TH3D336M016A0600 | CAP TANT 33UF 16V 20% 2917 |
| GBA18DTKT-S288 | CONN EDGECARD 36POS .125 EXTEND |
| RSM03DRKN | CONN EDGECARD 6POS DIP .156 SLD |
| GBA22DRMI-S288 | CONN EDGECARD 44POS .125 EXTEND |
相关代理商/技术参数 |
参数描述 |
|---|---|
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