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参数资料
| 型号： | EP1C6T256I8ES |
| 厂商： | Altera Corporation |
| 英文描述： | Cyclone FPGA Family Data Sheet |
| 中文描述： | 气旋的FPGA系列数据手册 |
| 文件页数： | 81/104页 |
| 文件大小： | 763K |
| 代理商： | EP1C6T256I8ES |
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Altera Corporation
January 2007
4–11
Preliminary
Timing Model
Internal Timing Parameters
Internal timing parameters are specified on a speed grade basis
independent of device density.
Tables 4–21
through
4–24
describe the
Cyclone device internal timing microparameters for LEs, IOEs, M4K
memory structures, and MultiTrack interconnects.
M4K
memory
block
RAM 128 × 36 bit
Single port
-
4,608
1
256.00
222.67
197.01
RAM 128 × 36 bit
Simple
dual-port
mode
-
4,608
1
255.95
222.67
196.97
RAM 256 × 18 bit
True dual-
port mode
-
4,608
1
255.95
222.67
196.97
FIFO 128 × 36 bit
-
40
4,608
1
256.02
222.67
197.01
Shift register
9 × 4 × 128
Shift
register
11
4,536
1
255.95
222.67
196.97
Note to
Table 4–20
:
(1)
The performance numbers for this function are from an EP1C6 device in a 240-pin PQFP package.
Table 4–20. Cyclone Device Performance
Resource
Used
Design Size &
Function
Mode
Resources Used
Performance
LEs
M4K
Memory
Bits
M4K
Memory
Blocks
-6 Speed
Grade
(MHz)
-7 Speed
Grade
(MHz)
-8 Speed
Grade
(MHz)
Table 4–21. LE Internal Timing Microparameter Descriptions
Symbol
Parameter
t
SU
LE register setup time before clock
t
H
LE register hold time after clock
t
CO
LE register clock-to-output delay
t
LUT
LE combinatorial LUT delay for data-in to data-out
t
CLR
Minimum clear pulse width
t
PRE
Minimum preset pulse width
t
CLKHL
Minimum clock high or low time
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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| EP1F-B3G1 | 制造商:NEC 制造商全称:NEC 功能描述:HIGH HEAT RESISTIVITY |
| EP1FB3G1S | 制造商:World Products 功能描述:Electromechanical Relay SPDT 25A 12VDC 225Ohm Through Hole |
| EP1F-B3G1T | 制造商:NEC 制造商全称:NEC 功能描述:HIGH HEAT RESISTIVITY |
| EP1F-B3G1TT | 制造商:NEC 制造商全称:NEC 功能描述:HIGH HEAT RESISTIVITY |
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