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参数资料
| 型号： | EP1S80F1508C7ES |
| 厂商： | Altera Corporation |
| 英文描述： | Stratix Device Family Data Sheet |
| 中文描述： | Stratix系列器件数据手册 |
| 文件页数： | 282/290页 |
| 文件大小： | 3559K |
| 代理商： | EP1S80F1508C7ES |
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4–102
Stratix Device Handbook, Volume 1
Altera Corporation
July 2005
DLL Jitter
DLL Jitter
Table 4–134
reports the jitter for the DLL in the DQS phase shift reference
circuit.
f
For more information on DLL jitter, see the
DDR SRAM
section in the
Stratix Architecture
chapter of the
Stratix Device Handbook, Volume 1
.
t
ARESET
Minimum pulse width on
areset
signal
10
ns
Notes to
Tables 4–131
through
4–133
:
(1)
See
“Maximum Input & Output Clock Rates” on page 4–76
.
(2)
PLLs 7, 8, 9, and 10 in the EP1S80 device support up to 717-MHz input and output.
(3)
Use this equation (f
OUT
= f
IN
*
ml
(
n
× post-scale counter)) in conjunction with the specified f
INPFD
and f
VCO
ranges to determine the allowed PLL settings.
(4)
When using the SERDES, high-speed differential I/O mode supports a maximum output frequency of 210 MHz
to the global or regional clocks (that is, the maximum data rate 840 Mbps divided by the smallest SERDES J factor
of 4).
(5)
Refer to the section
“High-Speed I/O Specification” on page 4–87
for more information.
(6)
This parameter is for high-speed differential I/O mode only.
(7)
These counters have a maximum of 32 if programmed for 50/50 duty cycle. Otherwise, they have a maximum
of 16.
(8)
High-speed differential I/O mode supports
W
= 1 to 16 and
J
= 4, 7, 8, or 10.
Table 4–133. Fast PLL Specifications for -8 Speed Grades (Part 2 of 2)
Symbol
Parameter
Min
Max
Unit
Table 4–134. DLL Jitter for DQS Phase Shift Reference Circuit
Frequency (MHz)
DLL Jitter (ps)
197 to 200
±
100
160 to 196
±
300
100 to 159
±
500
相关PDF资料 |
PDF描述 |
|---|---|
| EP20K100 | Programmable Logic Device Family |
| EP20K1000E | Programmable Logic Device Family |
| EP20K100E | Programmable Logic Device Family |
| EP20K1500E | Programmable Logic Device Family |
| EP20K160E | Programmable Logic Device Family |
相关代理商/技术参数 |
参数描述 |
|---|---|
| EP1S80F1508C7N | 功能描述:FPGA - 现场可编程门阵列 FPGA - Stratix I 7904 LABs 1203 IO RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 栅极数量: 逻辑块数量:943 内嵌式块RAM - EBR:1956 kbit 输入/输出端数量:128 最大工作频率:800 MHz 工作电源电压:1.1 V 最大工作温度:+ 70 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-256 |
| EP1S80F1508I5ES | 制造商:ALTERA 制造商全称:Altera Corporation 功能描述:Stratix Device Family Data Sheet |
| EP1S80F1508I6ES | 制造商:ALTERA 制造商全称:Altera Corporation 功能描述:Stratix Device Family Data Sheet |
| EP1S80F1508I7 | 功能描述:FPGA - 现场可编程门阵列 FPGA - Stratix I 7904 LABs 1203 IO RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 栅极数量: 逻辑块数量:943 内嵌式块RAM - EBR:1956 kbit 输入/输出端数量:128 最大工作频率:800 MHz 工作电源电压:1.1 V 最大工作温度:+ 70 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-256 |
| EP1S80F1508I7ES | 制造商:ALTERA 制造商全称:Altera Corporation 功能描述:Stratix Device Family Data Sheet |
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