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参数资料
| 型号： | EP20K100E |
| 厂商： | Altera Corporation |
| 英文描述： | Programmable Logic Device Family |
| 中文描述： | 可编程逻辑器件系列 |
| 文件页数： | 75/117页 |
| 文件大小： | 570K |
| 代理商： | EP20K100E |
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Altera Corporation
75
APEX 20K Programmable Logic Device Family Data Sheet
Note to
Table 36
:
(1)
These parameters are worst-case values for typical applications. Post-compilation
timing simulation and timing analysis are required to determine actual worst-case
performance.
Tables 38
and
39
describe the APEX 20KE external timing parameters.
Table 36. APEX 20KE Routing Timing Microparameters
Note (1)
Symbol
Parameter
t
F1-4
t
F5-20
t
F20+
Fanout delay using Local Interconnect
Fanout delay estimate using MegaLab Interconnect
Fanout delay estimate using FastTrack Interconnect
Table 37. APEX 20KE Functional Timing Microparameters
Symbol
Parameter
TCH
TCL
TCLRP
TPREP
TESBCH
TESBCL
TESBWP
TESBRP
Minimum clock high time from clock pin
Minimum clock low time from clock pin
LE clear Pulse Width
LE preset pulse width
Clock high time for ESB
Clock low time for ESB
Write pulse width
Read pulse width
Table 38. APEX 20KE External Timing Parameters
Note (1)
Symbol
Clock Parameter
Conditions
t
INSU
t
INH
t
OUTCO
t
INSUPLL
t
INHPLL
t
OUTCOPLL
Setup time with global clock at IOE input register
Hold time with global clock at IOE input register
Clock-to-output delay with global clock at IOE output register
Setup time with PLL clock at IOE input register
Hold time with PLL clock at IOE input register
Clock-to-output delay with PLL clock at IOE output register
C1 = 10 pF
C1 = 10 pF
相关PDF资料 |
PDF描述 |
|---|---|
| EP20K1500E | Programmable Logic Device Family |
| EP20K160E | Programmable Logic Device Family |
| EP20K200 | Programmable Logic Device Family |
| EP20K200E | Programmable Logic Device Family |
| EP20K300E | Programmable Logic Device Family |
相关代理商/技术参数 |
参数描述 |
|---|---|
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| EP20K100EBC356-1ES | 制造商:未知厂家 制造商全称:未知厂家 功能描述:FPGA |
| EP20K100EBC356-1X | 功能描述:FPGA - 现场可编程门阵列 CPLD - APEX 20K 416 Macro 246 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 栅极数量: 逻辑块数量:943 内嵌式块RAM - EBR:1956 kbit 输入/输出端数量:128 最大工作频率:800 MHz 工作电源电压:1.1 V 最大工作温度:+ 70 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-256 |
| EP20K100EBC356-2 | 功能描述:FPGA - 现场可编程门阵列 CPLD - APEX 20K 416 Macro 246 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 栅极数量: 逻辑块数量:943 内嵌式块RAM - EBR:1956 kbit 输入/输出端数量:128 最大工作频率:800 MHz 工作电源电压:1.1 V 最大工作温度:+ 70 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-256 |
| EP20K100EBC356-2ES | 制造商:未知厂家 制造商全称:未知厂家 功能描述:FPGA |
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