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参数资料
| 型号： | EP20K100EFI784-3 |
| 厂商： | ALTERA CORP |
| 元件分类： | PLD |
| 英文描述： | LOADABLE PLD, PBGA784 |
| 文件页数： | 46/65页 |
| 文件大小： | 781K |
| 代理商： | EP20K100EFI784-3 |
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72
Altera Corporation
APEX 20K Programmable Logic Device Family Data Sheet
Preliminary Information
Notes:
(1)
The most significant bit (MSB) is on the left.
(2)
The IDCODE’s least significant bit (LSB) is always 1.
(3)
Consult Altera Applications for up-to-date information on this device.
Figure 32 shows the timing requirements for the JTAG signals.
Figure 32. APEX 20K JTAG Waveforms
Table 13. 32-Bit APEX 20K Device IDCODE
Device
IDCODE (32 Bits)
Version
(4 Bits)
Part Number (16 Bits)
Manufacturer
Identity (11 Bits)
1 (1 Bit)
EP20K100
0000
0000 0100 0001 0110
000 0110 1110
1
EP20K100E
000 0110 1110
1
EP20K160E
000 0110 1110
1
EP20K200
0000
0000 1000 0011 0010
000 0110 1110
1
EP20K200E
000 0110 1110
1
EP20K300E
000 0110 1110
1
EP20K400
0000
0001 0110 0110 0100
000 0110 1110
1
EP20K400E
000 0110 1110
1
EP20K600E
000 0110 1110
1
EP20K1000E
000 0110 1110
1
TDO
TCK
tJPZX
t
JPCO
tJPH
t JPXZ
tJCP
tJPSU
t JCL
tJCH
TDI
TMS
Signal
to Be
Captured
Signal
to Be
Driven
t
JSZX
tJSSU
tJSH
t
JSCO
tJSXZ
相关PDF资料 |
PDF描述 |
|---|---|
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相关代理商/技术参数 |
参数描述 |
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| EP20K100EQC208-2 | 功能描述:FPGA - 现场可编程门阵列 CPLD - APEX 20K 416 Macro 151 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 栅极数量: 逻辑块数量:943 内嵌式块RAM - EBR:1956 kbit 输入/输出端数量:128 最大工作频率:800 MHz 工作电源电压:1.1 V 最大工作温度:+ 70 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-256 |
| EP20K100EQC208-2ES | 制造商:未知厂家 制造商全称:未知厂家 功能描述:FPGA |
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