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参数资料
| 型号： | EP20K100EFI784-3 |
| 厂商： | ALTERA CORP |
| 元件分类： | PLD |
| 英文描述： | LOADABLE PLD, PBGA784 |
| 文件页数： | 49/65页 |
| 文件大小： | 781K |
| 代理商： | EP20K100EFI784-3 |
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Altera Corporation
75
Preliminary Information
APEX 20K Programmable Logic Device Family Data Sheet
VO
Output voltage
0
VCCIO
V
TJ
Operating temperature
For commercial use
0
85
° C
For industrial use
–40
100
° C
tR
Input rise time
40
ns
tF
Input fall time
40
ns
Table 17. APEX 20K Device DC Operating Conditions (Part 1 of 2)
Notes (6), (7)
Symbol
Parameter
Conditions
Min
Typ
Max
Unit
VIH
High-level LVTTL, CMOS, or 3.3-V
PCI input voltage
1.7, 0.5
× V
CCIO
4.1
V
VIL
Low-level LVTTL, CMOS, or 3.3-V
PCI input voltage
–0.5
0.7, 0.3
× V
CCIO
V
VOH
3.3-V high-level LVTTL output
voltage
IOH = –12 mA DC,
2.4
V
3.3-V high-level LVCMOS output
voltage
IOH = –0.1 mA DC,
VCCIO – 0.2
V
3.3-V high-level PCI output voltage IOH = –0.5 mA DC,
0.9
× V
CCIO
V
2.5-V high-level output voltage
IOH = –0.1 mA DC,
2.1
V
IOH = –1 mA DC,
2.0
V
IOH = –2 mA DC,
1.7
V
VOL
3.3-V low-level LVTTL output
voltage
IOL = 12 mA DC,
0.45
V
3.3-V low-level LVCMOS output
voltage
IOL = 0.1 mA DC,
0.2
V
3.3-V low-level PCI output voltage IOL = 1.5 mA DC,
VCCIO = 3.00 to 3.60 V
0.1
× V
CCIO
V
2.5-V low-level output voltage
IOL = 0.1 mA DC,
0.2
V
IOL = 1 mA DC,
0.4
V
IOL = –12 mA DC,
0.7
V
II
Input pin leakage current
VI = 4.1 to –0.5 V
–10
10
A
IOZ
Tri-stated I/O pin leakage current
VO = 4.1 to –0.5 V
–10
10
A
Table 16. APEX 20K Device Recommended Operating Conditions (Part 2 of 2)
Symbol
Parameter
Conditions
Min
Max
Unit
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PDF描述 |
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参数描述 |
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| EP20K100EQC208-2ES | 制造商:未知厂家 制造商全称:未知厂家 功能描述:FPGA |
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