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参数资料
| 型号： | EP20K400FC672-2 |
| 英文描述： | Field Programmable Gate Array (FPGA) |
| 中文描述： | 现场可编程门阵列（FPGA） |
| 文件页数： | 106/114页 |
| 文件大小： | 1623K |
| 代理商： | EP20K400FC672-2 |
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Altera Corporation
91
APEX 20K Programmable Logic Device Family Data Sheet
Table 66. EP20K100E Fmax ESBTiming Microparameters
Symbol
-1
-2
-3
Unit
Min
Max
Min
Max
Min
Max
tESBARC
1.61
1.84
1.97
ns
tESBSRC
2.57
2.97
3.20
ns
tESBAWC
0.52
4.09
4.39
ns
tESBSWC
3.17
3.78
4.09
ns
tESBWASU
0.56
6.41
0.63
ns
tESBWAH
0.48
0.54
0.55
ns
tESBWDSU
0.71
0.80
0.81
ns
tESBWDH
.048
0.54
0.55
ns
tESBRASU
1.57
1.75
1.87
ns
tESBRAH
0.00
0.20
ns
tESBWESU
1.54
1.72
1.80
ns
tESBDATASU
-0.16
-0.20
ns
tESBWADDRSU
0.12
0.08
0.13
ns
tESBRADDRSU
0.17
0.15
0.19
ns
tESBDATACO1
1.20
1.39
1.52
ns
tESBDATACO2
2.54
2.99
3.22
ns
tESBDD
3.06
3.56
3.85
ns
tPD
1.73
2.02
2.20
ns
tPTERMSU
1.11
1.26
1.38
ns
tPTERMCO
1.19
1.40
1.08
ns
Table 67. EP20K100E Fmax Routing Delays
Symbol
-1
-2
-3
Unit
Min
Max
Min
Max
Min
Max
tF1-4
0.24
0.27
0.29
ns
tF5-20
1.04
1.26
1.52
ns
tF20+
1.12
1.36
1.86
ns
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PDF描述 |
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参数描述 |
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