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参数资料
| 型号： | EP20K600EBI652-2ES |
| 元件分类： | CPU监测 |
| 英文描述： | RTC Module With CPU Supervisor |
| 中文描述： | 时钟模块CPU监控 |
| 文件页数： | 55/114页 |
| 文件大小： | 1623K |
| 代理商： | EP20K600EBI652-2ES |
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Altera Corporation
45
APEX 20K Programmable Logic Device Family Data Sheet
Figure 29. APEX 20KE I/O Banks
Notes:
(1)
The first two I/O pins that border the LVDS blocks can only be used for input to
maintain an acceptable noise level on the VCCIO plane.
(2)
If the LVDS input and output blocks are not used for LVDS, they can support all of
the I/O standards and can be used as input, output, or bidirectional pins with
VCCIO set to 3.3 V, 2.5 V, or 1.8 V.
Power Sequencing & Hot Socketing
Because APEX 20K and APEX 20KE devices can be used in a mixed-
voltage environment, they have been designed specifically to tolerate any
possible power-up sequence. Therefore, the VCCIO and VCCINT power
supplies may be powered in any order.
Signals can be driven into APEX 20K devices before and during power-up
without damaging the device. In addition, APEX 20K devices do not drive
out during power-up. Once operating conditions are reached and the
device is configured, APEX 20K and APEX 20KE devices operate as
specified by the user.
Under hot socketing conditions, APEX 20KE devices will not sustain any
damage, but the I/O pins will drive out.
LVDS/LVPECL
Input
Block (2)
(1)
LVDS/LVPECL
Output
Block (2)
(1)
Regular I/O Blocks Support
s LVTTL
s LVCMOS
s 2.5 V
s 1.8 V
s 3.3 V PCI
s LVPECL
s HSTL Class I
s GTL+
s SSTL-2 Class I and II
s SSTL-3 Class I and II
s CTT
s AGP
Individual
Power Bus
I/O Bank 8
I/O Bank 1
I/O Bank 2
I/O Bank 3
I/O Bank 4
I/O Bank 5
I/O Bank 6
I/O Bank 7
相关PDF资料 |
PDF描述 |
|---|---|
| EP20K600EBI652-3ES | RTC Module With CPU Supervisor |
| EP20K600EFC1020-1 | RTC Module With CPU Supervisor |
| EP20K600EFC1020-1ES | FPGA |
| EP20K600EFC1020-1X | FPGA |
| EP20K600EFC1020-2 | FPGA |
相关代理商/技术参数 |
参数描述 |
|---|---|
| EP20K600EBI652-2X | 功能描述:FPGA - 现场可编程门阵列 CPLD - APEX 20K 2432 Macros 488 IO RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 栅极数量: 逻辑块数量:943 内嵌式块RAM - EBR:1956 kbit 输入/输出端数量:128 最大工作频率:800 MHz 工作电源电压:1.1 V 最大工作温度:+ 70 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-256 |
| EP20K600EBI652-3ES | 制造商:未知厂家 制造商全称:未知厂家 功能描述:FPGA |
| EP20K600EFC1020-1 | 制造商:未知厂家 制造商全称:未知厂家 功能描述:FPGA |
| EP20K600EFC1020-1ES | 制造商:未知厂家 制造商全称:未知厂家 功能描述:FPGA |
| EP20K600EFC1020-1X | 制造商:未知厂家 制造商全称:未知厂家 功能描述:FPGA |
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