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参数资料
| 型号： | EPF10K130E |
| 厂商： | Altera Corporation |
| 英文描述： | Embedded Programmable Logic Family(FLEX10KE嵌入式可编程逻辑系列) |
| 中文描述： | 嵌入式可编程逻辑系列（FLEX10KE嵌入式可编程逻辑系列） |
| 文件页数： | 8/121页 |
| 文件大小： | 2001K |
| 代理商： | EPF10K130E |
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Altera Corporation
FLEX 10KE Embedded Programmable Logic Family Data Sheet
Preliminary Information
The logic array consists of logic array blocks (LABs). Each LAB contains
eight LEs and a local interconnect. An LE consists of a 4-input look-up
table (LUT), a programmable flipflop, and dedicated signal paths for carry
and cascade functions. The eight LEs can be used to create medium-sized
blocks of logic—such as 8-bit counters, address decoders, or state
machines—or combined across LABs to create larger logic blocks. Each
LAB represents about 96 usable gates of logic.
Signal interconnections within FLEX 10KE devices (as well as to and from
device pins) are provided by the FastTrack Interconnect routing structure,
which is a series of fast, continuous row and column channels that run the
entire length and width of the device.
Each I/O pin is fed by an I/O element (IOE) located at the end of each row
and column of the FastTrack Interconnect routing structure. Each IOE
contains a bidirectional I/O buffer and a flipflop that can be used as either
an output or input register to feed input, output, or bidirectional signals.
When used with a dedicated clock pin, these registers provide exceptional
performance. As inputs, they provide setup times as low as 2.5 ns and
hold times of 0 ns. As outputs, these registers provide clock-to-output
times as low as 3.7 ns. IOEs provide a variety of features, such as JTAG
BST support, slew-rate control, tri-state buffers, and open-drain outputs.
相关PDF资料 |
PDF描述 |
|---|---|
| EPF10K200S | Embedded Programmable Logic Family(FLEX10KE嵌入式可编程逻辑系列) |
| EPF10K40 | Embedded Programmable Logic Family(FLEX10K嵌入式可编程逻辑系列) |
| EPF10K50E | Embedded Programmable Logic Family(FLEX10KE嵌入式可编程逻辑系列) |
| EPF10K50V | Embedded Programmable Logic Family(FLEX10K嵌入式可编程逻辑系列) |
| EPF6010A | Programmable Logic Device Family(FLEX6000可编程逻辑系列器件) |
相关代理商/技术参数 |
参数描述 |
|---|---|
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| EPF10K130EBC356-1X | 功能描述:FPGA - 现场可编程门阵列 FPGA - Flex 10K 832 LABs 274 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 栅极数量: 逻辑块数量:943 内嵌式块RAM - EBR:1956 kbit 输入/输出端数量:128 最大工作频率:800 MHz 工作电源电压:1.1 V 最大工作温度:+ 70 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-256 |
| EPF10K130EBC356-2 | 功能描述:FPGA - 现场可编程门阵列 FPGA - Flex 10K 832 LABs 274 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 栅极数量: 逻辑块数量:943 内嵌式块RAM - EBR:1956 kbit 输入/输出端数量:128 最大工作频率:800 MHz 工作电源电压:1.1 V 最大工作温度:+ 70 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-256 |
| EPF10K130EBC356-2X | 功能描述:FPGA - 现场可编程门阵列 FPGA - Flex 10K 832 LABs 274 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 栅极数量: 逻辑块数量:943 内嵌式块RAM - EBR:1956 kbit 输入/输出端数量:128 最大工作频率:800 MHz 工作电源电压:1.1 V 最大工作温度:+ 70 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-256 |
| EPF10K130EBC356-3 | 功能描述:FPGA - 现场可编程门阵列 FPGA - Flex 10K 832 LABs 274 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 栅极数量: 逻辑块数量:943 内嵌式块RAM - EBR:1956 kbit 输入/输出端数量:128 最大工作频率:800 MHz 工作电源电压:1.1 V 最大工作温度:+ 70 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-256 |
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