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参数资料
| 型号： | EPF10K30EFC256-2 |
| 英文描述： | Field Programmable Gate Array (FPGA) |
| 中文描述： | 现场可编程门阵列（FPGA） |
| 文件页数： | 54/120页 |
| 文件大小： | 1901K |
| 代理商： | EPF10K30EFC256-2 |
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Altera Corporation
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FLEX 10KE Embedded Programmable Logic Family Data Sheet
ClockLock & ClockBoost Timing Parameters
For the ClockLock and ClockBoost circuitry to function properly, the
incoming clock must meet certain requirements. If these specifications are
not met, the circuitry may not lock onto the incoming clock, which
generates an erroneous clock within the device. The clock generated by
the ClockLock and ClockBoost circuitry must also meet certain
specifications. If the incoming clock meets these requirements during
configuration, the ClockLock and ClockBoost circuitry will lock onto the
clock during configuration. The circuit will be ready for use immediately
after configuration. Figure 19 shows the incoming and generated clock
specifications.
Figure 19. Specications for Incoming & Generated Clocks
The tI parameter refers to the nominal input clock period; the tO parameter refers to the
nominal output clock period.
tR
tF
tCLK1
tINDUTY
tI ± fCLKDEV
tI
tI ± tINCLKSTB
tOUTDUTY
tO
tO + tJITTER
tO – tJITTER
Input
Clock
ClockLock-
Generated
Clock
相关PDF资料 |
PDF描述 |
|---|---|
| EPF10K30EFC256-2DX | ASIC |
| EPF10K30EFC256-2X | Field Programmable Gate Array (FPGA) |
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| EPF10K30EFC256-3DX | ASIC |
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相关代理商/技术参数 |
参数描述 |
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