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参数资料
| 型号： | EPF6016ATC100-3 |
| 厂商： | Altera |
| 文件页数： | 17/52页 |
| 文件大小： | 0K |
| 描述： | IC FLEX 6000 FPGA 16K 100-TQFP |
| 产品培训模块： | Three Reasons to Use FPGA's in Industrial Designs |
| 标准包装： | 270 |
| 系列： | FLEX 6000 |
| LAB/CLB数： | 132 |
| 逻辑元件/单元数： | 1320 |
| 输入/输出数： | 81 |
| 门数： | 16000 |
| 电源电压： | 3 V ~ 3.6 V |
| 安装类型： | 表面贴装 |
| 工作温度： | 0°C ~ 85°C |
| 封装/外壳： | 100-TQFP |
| 供应商设备封装： | 100-TQFP（14x14） |
| 产品目录页面： | 602 (CN2011-ZH PDF) |
| 其它名称： | 544-1274 |
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24
Altera Corporation
FLEX 6000 Programmable Logic Device Family Data Sheet
Each IOE drives a row or column interconnect when used as an input or
bidirectional pin. A row IOE can drive up to six row lines; a column IOE
can drive up to two column lines. The input path from the I/O pad to the
FastTrack Interconnect has a programmable delay element that can be
used to guarantee a zero hold time. Depending on the placement of the
IOE relative to what it is driving, the designer may choose to turn on the
programmable delay to ensure a zero hold time. Figure 13 shows how an
IOE connects to a row interconnect, and Figure 14 shows how an IOE
connects to a column interconnect.
Figure 13. IOE Connection to Row Interconnect
Row Interconnect
Any LE can drive
a pin through the
row and local
interconnect.
FastFLEX I/O: An LE can drive a pin through the
local interconnect for faster clock-to-output times.
IOE
Up to 10 IOEs are on either
side of a row. Each IOE can
drive up to six row
channels, and each IOE data
and OE signal is driven by
the local interconnect.
LAB
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PDF描述 |
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参数描述 |
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