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参数资料
| 型号： | EPM7032BLC44-3 |
| 厂商： | Altera |
| 文件页数： | 17/66页 |
| 文件大小： | 0K |
| 描述： | IC MAX 7000 CPLD 32 44-PLCC |
| 标准包装： | 130 |
| 系列： | MAX® 7000B |
| 可编程类型： | 系统内可编程 |
| 最大延迟时间 tpd(1)： | 3.5ns |
| 电压电源 - 内部： | 2.375 V ~ 2.625 V |
| 逻辑元件/逻辑块数目： | 2 |
| 宏单元数： | 32 |
| 门数： | 600 |
| 输入/输出数： | 36 |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 44-LCC（J 形引线） |
| 供应商设备封装： | 44-PLCC（16.58x16.58） |
| 包装： | 管件 |
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Altera Corporation
MAX 7000B Programmable Logic Device Data Sheet
MAX 7000B devices contain two I/O banks. Both banks support all
standards. Each I/O bank has its own VCCIO pins. A single device can
support 1.8-V, 2.5-V, and 3.3-V interfaces; each bank can support a
different standard independently. Within a bank, any one of the
terminated standards can be supported.
Figure 9 shows the arrangement of the MAX 7000B I/O banks.
Figure 9. MAX 7000B I/O Banks for Various Advanced I/O Standards
Table 11 shows which macrocells have pins in each I/O bank.
Each MAX 7000B device has two VREF pins. Each can be set to a separate
VREF level. Any I/O pin that uses one of the voltage-referenced standards
(GTL+, SSTL-2, or SSTL-3) may use either of the two VREF pins. If these
pins are not required as VREF pins, they may be individually
programmed to function as user I/O pins.
Table 11. Macrocell Pins Contained in Each I/O Bank
Device
Bank 1
Bank 2
EPM7032B
1-16
17-32
EPM7064B
1-32
33-64
EPM7128B
1-64
65-128
EPM7256B
1-128, 177-181
129-176, 182-256
EPM7512B
1-265
266-512
Individual
Power Bus
Programmable I/O Banks
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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| EPM7032BLC44-5 | 制造商:Rochester Electronics LLC 功能描述: 制造商:Altera Corporation 功能描述: |
| EPM7032BLC44-7 | 制造商:Rochester Electronics LLC 功能描述: 制造商:Altera Corporation 功能描述: |
| EPM7032BTC44-3 | 制造商:Altera Corporation 功能描述:IC MAX |
| EPM7032BTC44-3N | 制造商:Altera Corporation 功能描述:IC MAX |
| EPM7032BTC44-5 | 制造商:Altera Corporation 功能描述:CPLD MAX 7000B Family 600 Gates 32 Macro Cells 212.8MHz CMOS Technology 2.5V 44-Pin TQFP |
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